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参数资料
| 型号： | WJLXT388LEB2 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP100 |
| 封装： | 14 X 14MM, ROHS COMPLIANT, LQFP-100 |
| 文件页数： | 41/80页 |
| 文件大小： | 1017K |
| 代理商： | WJLXT388LEB2 |
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Intel
LXT388 — Dual T1/E1/J1 Transceiver
46
Datasheet
4.0
JTAG Boundary Scan
4.1
Overview
The LXT388 supports IEEE 1149.1 compliant JTAG boundary scan. Boundary scan allows easy
access to the interface pins for board testing purposes.
In addition to the traditional IEE1149.1 digital boundary scan capabilities, the LXT388 also
includes analog test port capabilities. This feature provides access to the TIP and RING signals in
each channel (transmit and receive). This way, the signal path integrity across the primary winding
of each coupling transformer can be tested.
4.2
Architecture
Figure 16 represents the LXT388 basic JTAG architecture. The LXT388 JTAG architecture
includes a TAP Test Access Port Controller, data registers and an instruction register. The
following paragraphs describe these blocks in detail.
4.3
TAP Controller
The TAP controller is a 16 state synchronous state machine controlled by the TMS input and
clocked by TCK (Figure 17).The TAP controls whether the LXT388 is in reset mode, receiving an
instruction, receiving data, transmitting data or in an idle state. Table 34 describes in detail each of
the states represented in Figure 17.
Figure 16. LXT388 JTAG Architecture
MUX
TDO
TAP
Controller
TCK
TMS
TRST
TDI
Boundry Scan Data Register
BSR
Analog Port Scan Register
ASR
Device Identification Register
IDR
Bypass Register
BYR
Instruction Register
IR
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