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参数资料
| 型号： | WJLXT388LEB2 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP100 |
| 封装： | 14 X 14MM, ROHS COMPLIANT, LQFP-100 |
| 文件页数： | 47/80页 |
| 文件大小： | 1017K |
| 代理商： | WJLXT388LEB2 |
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Dual T1/E1/J1 Transceiver — Intel
LXT388
Datasheet
51
4.4.2
Device Identification Register (IDR)
The IDR register provides access to the manufacturer number, part number and the LXT388
revision. The register is arranged per IEEE 1149.1 and is represented in Table 36. Data into the IDR
is shifted in LSB first.
4.4.3
Bypass Register (BYR)
The Bypass Register is a 1 bit register that allows direct connection between the TDI input and the
TDO output.
4.4.4
Analog Port Scan Register (ASR)
The ASR is a 5 bit shift register used to control the analog test port at pins AT1, AT2. When the
INTEST_ANALOG instruction is selected, TDI connects to the ASR input and TDO connects to
the ASR output. After 5 TCK rising edges, a 5 bit control code is loaded into the ASR. Data into
the ASR is shifted in LSB first.
RNEG1
O
RNEG1
LOS1
O
LOS1
TCLK0
I
TCLK0
TPOS0
I
TPOS0
TNEG0
I
TNEG0
RCLK0
O
RCLK0
RPOS0
O
RPOS0
N/A
-
HIZ0
HIZ0 controls the RPOS0, RNEG0 and RCLK0 pins. Setting HIZ0 to “0”
enables output on the pins. Setting HIZ0 to “1” tristates the pins.
RNEG0
O
RNEG0
LOS0
O
LOS0
Table 35. Boundary Scan Register (BSR) (Continued)
Bit #
Pin
Signal
I/O
Type
Bit
Symbol
Comments
1. LOOP4 corresponds to DLOOP0.
2. LOOP5 corresponds to DLOOP1.
3. LOOP6 corresponds to DLOOP2.
4. LOOP7 corresponds to DLOOP3..
Table 36. Device Identification Register (IDR)
Bit #
Comments
31 - 28
Revision Number
27 - 12
Part Number
11 - 1
Manufacturer Number
0
Set to “1”
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PDF描述 |
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