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参数资料
| 型号： | WJLXT388LEB2 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP100 |
| 封装： | 14 X 14MM, ROHS COMPLIANT, LQFP-100 |
| 文件页数： | 42/80页 |
| 文件大小： | 1017K |
| 代理商： | WJLXT388LEB2 |
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Dual T1/E1/J1 Transceiver — Intel
LXT388
Datasheet
47
Table 34. TAP State Description
State
Description
Test Logic Reset
In this state the test logic is disabled. The device is set to normal operation mode. While
in this state, the instruction register is set to the ICODE instruction.
Run -Test/Idle
The TAP controller stays in this state as long as TMS is low. Used to perform tests.
Capture - DR
The Boundary Scan Data Register (BSR) is loaded with input pin data.
Shift - DR
Shifts the selected test data registers by one stage word its serial output.
Update - DR
Data is latched into the parallel output of the BSR when selected.
Capture - IR
Used to load the instruction register with a fixed instruction.
Shift - IR
Shifts the instruction register by one stage.
Update - IR
Loads a new instruction into the instruction register.
Pause - IR
Pause - DR
Momentarily pauses shifting of data through the data/instruction registers.
Exit1 - IR
Exit1 - DR
Exit2 - IR
Exit2 - DR
Temporary states that can be used to terminate the scanning process.
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