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参数资料
| 型号： | ZL50114GAG |
| 厂商： | XILINX INC |
| 元件分类： | 通信及网络 |
| 英文描述： | SPECIALTY TELECOM CIRCUIT, PBGA552 |
| 封装： | 35 X 35 MM, 1.27 MM PITCH, PLASTIC, MS-034, BGA-552 |
| 文件页数： | 101/113页 |
| 文件大小： | 2004K |
| 代理商： | ZL50114GAG |
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ZL50110/11/12/14
Data Sheet
88
Zarlink Semiconductor Inc.
Figure 32 - TDM - H-MVIP Timing Diagram for 16 MHz Clock (8.192 Mbps)
11.4
TDM LIU Interface Timing
The TDM Interface can be used to directly drive into a Line Interface Unit (LIU). The interface can work in this mode
with E1, DS1, J2, E3 and DS3. The frame pulse is not present, just data and clock is transmitted and received.
Table 30 shows timing for DS3, which would be the most stringent requirement.
TDM_HDS Input Setup
tS
30
-
ns
TDM_HDS Input Hold
tH
30
-
ns
TDM_F0 width
tFW
200
244
300
ns
TDM_F0 setup
tFS
50
-
150
ns
TDM_F0 hold
tFH
50
-
150
ns
Parameter
Symbol
Min.
Typ.
Max.
Units
Notes
TDM_TXCLK Period
tCTP
22.353
ns
DS3 clock
TDM_TXCLK High
tCTH
6.7
ns
TDM_TXCLK Low
tCTL
6.7
ns
TDM_RXCLK Period
tCRP
22.353
ns
DS3 clock
TDM_RXCLK High
tCRH
9.0
ns
TDM_RXCLK Low
tCRL
9.0
ns
TDM_TXDATA Output Delay
tPD
3-
10
ns
TDM_RXDATA Input Setup
tS
6ns
TDM_RXDATA Input Hold
tH
3ns
Table 33 - TDM - LIU Structured Transmission/Reception
Parameter
Symbol
Min.
Typ.
Max.
Units
Notes
Table 32 - TDM H-MVIP Timing Specification (continued)
tC16P
Ts 127 Bit 7
Ts 0 Bit 0
Ts 0 Bit 1
Ch 127 Bit 7
Ch 0 Bit 0
tPD
tHZD
tH
tS
tFH
tFS
tFW
ttC16H
ttC16L
TDM_C16
TDM_F0
TDM_HDS Input
TDM_HDS Output
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