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参数资料
| 型号： | ADUC7032BSTZ-8V-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 77/128页 |
| 文件大小： | 0K |
| 描述： | IC BATTERY SENSOR PREC 48-LQFP |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心处理器： | ARM7 |
| 芯体尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 连通性： | LIN，SPI，UART/USART |
| 外围设备： | POR，PSM，温度传感器，WDT |
| 输入/输出数： | 9 |
| 程序存储器容量： | 96KB（48K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1.5K x 32 |
| 电压 - 电源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 数据转换器： | A/D 2x16b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 48-LQFP |
| 包装： | 标准包装 |
| 其它名称： | ADUC7032BSTZ-8V-RLDKR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页当前第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
Preliminary Technical Data
ADuC7032
Rev. PrD | Page 52 of 128
1, 1, 0 ADC System Zero-Scale Calibration
In this mode, an zero-scale calibration is performed on enabled ADC channels against an external zero-scale voltage
driven at the ADC input pins. The calibration is carried out at the user programmed ADC settings, therefore, as with a
normal single ADC conversion, it will take 3 ADC conversion cycles before a fully settled calibration result is ready.
1, 1, 1 ADC System Full-Scale Calibration
In this mode, an full-scale calibration is performed on enabled ADC channels against an external full-scale voltage
driven at the ADC input pins.
Current Channel ADC Control Register :
Name :
ADC0CON
Address :
0xFFFF050C
Default Value :
0x0002
Access :
Read/Write
Function :
The Current Channel ADC Control MMR is an 16-bit register that is used to configure the I-ADC.
Note:
If the Current ADC is reconfigured via ADC0CON, the Voltage and Temperature ADCs are also reset.
Table 24 : ADC0CON MMR Bit Designations
Bit
Description
15
Current Channel ADC Enable
This bit is set to 1 by user code to enable the I-ADC
Clearing this bit to 0, powers down the I-ADC and resets the respective ADC READY bit in the ADCSTA MMR to 0
14, 13
IIN Current Source Enable
0, 0
Current Sources Off
0, 1
Enable 50uA current source on IIN+
1, 0
Enable 50uA current source on IIN-
1, 1
Enable 50uA current source on both IIN- and IIN+
NOTE: These current sources have a tolerance of +-30%. A PGA gain equal to or greater than 2 ( ADC0CON [3-0 ] != 0000 )
must be used when current sources are enabled.
12– 10
Not Used
These bits are reserved for future functionality and should be written as zero
9
Current Channel ADC Output Coding
This bit is set to 1 by user code to configure I-ADC output coding as unipolar
This bit is cleared to 0 by user code to configure I-ADC output coding as 2’s complement
8
Not Used
This bit is reserved for future functionality and should be written as zero
7, 6
Current Channel ADC Input Select
0, 0
IIN+, IIN-
0, 1
IIN-, IIN-
Diagnostic, internal short configuration
1, 0
ADC Reference/136, 0V
Diagnostic, test voltage for gain settings <= 128
ADC Reference/(1.0625XGain), 0V
Diagnostic, test voltage for gain settings > 128
Note: If (REG_AVDD, AGND) divided by 2 Reference is selected, REG_AVDD is used for Vref in this mode. This will
lead to ADC0DAT scaled by two
1, 1
Not Defined
5, 4
Current Channel ADC Reference Select
0, 0
Internal, 1.2V precision reference selected. In ADC Low Power Mode, the Voltage Reference selection is
controlled by ADCMDE[5]
0, 1
External reference inputs (VREF, GND_SW) selected
1, 0
External reference inputs divided by 2 (VREF, GND_SW)/2 selected, this allows an external reference up to
REG_AVDD
1, 1
(REG_AVDD, AGND) divided by 2 selected
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