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参数资料
| 型号： | DS2196LN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 35/157页 |
| 文件大小： | 0K |
| 描述： | IC FRAMER DUAL T1 LIU 100-LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 控制器类型： | T1 调帧器 |
| 接口： | 并行/串行 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 电流 - 电源： | 85mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 托盘 |
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DS2196
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3. PIN FUNCTION DESCRIPTION
Transmit Side Pins
Signal Name:
TCLKA/B
Signal Description:
Transmit Clock
Signal Type:
Input
A 1.544 MHz primary clock is applied here. Used to clock data through the transmit side formatters. TCLKA/B
can be internally connected to RCLKB/A via the CCR4B.2 control bit.
Signal Name:
TSERA/B
Signal Description:
Transmit Serial Data
Signal Type:
Input
Transmit NRZ serial data. Sampled on the falling edge of TCLKA or TCLKB. TSERA/B can be internally
connected to RSERB/A via the CCR4B.2 control bit.
Signal Name:
TSYNCA/B
Signal Description:
Transmit Sync
Signal Type:
Input / Output
When programmed as an input, a pulse at this pin will establish either frame or multiframe boundaries for the
transmit side. Via TCR2A.2 and TCR2B.2, the DS2196 can be programmed to output either a frame or multiframe
pulse at this pin. If this pin is set to output pulses at frame boundaries, it can also be set via TCR2A.4 and
TCR2B.4 to output double–wide pulses at signaling frames. See Section 21 for details. TSYNCA/B can be
internally connected to RMSYNCB/A via the CCR4B.2 control bit.
Signal Name:
TCHCLKA/B / TLCLKA/B
Signal Description:
Transmit Channel Clock / Transmit Link Clock
Signal Type:
Output
A dual function pin depending on the setting of the CCR4A.1 and CCR4B.1 control bits. If TCHCLK is selected, a
192-kHz clock, which pulses high during the LSB of each channel, will be output. If TLCLK is selected, either a 4
kHz or 2 kHz (ZBTSI) demand clock for the TLINK data is output. This output signal is always synchronous with
TCLKA or TCLKB. See Section 21 for details.
Signal Name:
TCHBLKA/B / TLINKA/B
Signal Description:
Transmit Channel Block / Transmit Link Data
Signal Type:
Input / Output
A dual function pin depending on the setting of the CCR4A.1 and CCR4B.1 control bits. If TCHBLK is selected, a
user programmable output that can be forced high or low during any of the 24 T1 channels is output. Useful for
blocking clocks to a serial UART or LAPD controller in applications where not all T1 channels are used such as
Fractional T1, 384 kbps service, 768 kbps, or ISDN–PRI. Also useful for locating individual channels in drop–
and–insert applications, for external per–channel loopback, and for per–channel conditioning. See Section 21 for
details. If TLINK is selected, this pin will be sampled on the falling edge of TCLKA or TCLKB for data insertion
into either the FDL stream (ESF) or the Fs–bit position (D4) or the Z–bit position (ZBTSI). See Section 21 for
details. This signal is always synchronous with TCLKA or TCLKB.
Signal Name:
TPOSOA/B / TNRZA/B
Signal Description:
Transmit Positive & NRZ Data Output
Signal Type:
Output
Updated on the rising edge of TCLKOA and rising or falling edge of TCLKOB with either bipolar data or NRZ
data out of the transmit side formatter. This pin can be programmed to source NRZ data via the Output Data
Format (CCR1A.6 and CCR1B.6) control bits.
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PDF描述 |
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参数描述 |
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