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参数资料
| 型号： | DSPB56362AG120 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 130/152页 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT AUD 120MHZ 144-LQFP |
| 标准包装： | 60 |
| 系列： | DSP56K/Symphony |
| 类型： | 音频处理器 |
| 接口： | 主机接口，I²C，SAI，SPI |
| 时钟速率： | 120MHz |
| 非易失内存： | ROM（126 kB） |
| 芯片上RAM： | 42kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 3.30V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-LQFP（20x20） |
| 包装： | 托盘 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页当前第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页
Serial Host Interface SPI Protocol Timing
DSP56362 Technical Data, Rev. 4
Freescale Semiconductor
3-53
144
Serial clock rise/fall time
Master
—
10
ns
Slave
—
2000
146
SS assertion to first SCK edge CPHA = 0
Slave
Bypassed
Narrow
Wide
3.5
×T
C+15
0
50
0
—
ns
CPHA = 1
Slave
Bypassed
Narrow
Wide
10
0
10
0
—
147
Last SCK edge to SS not asserted
slave
Bypassed
Narrow
Wide
12
102
189
12
102
189
—
ns
148
Data input valid to SCK edge (data input
set-up time)
Master/
Slave
Bypassed
Narrow
Wide
0
MAX{(20-TC), 0}
MAX{(40-TC), 0}
0
10
30
—
ns
149
SCK last sampling edge to data input not
valid
Master/
Slave
Bypassed
Narrow
Wide
2.5
×T
C+10
2.5
×T
C+30
2.5
×T
C+50
35
55
75
—
ns
150
SS assertion to data out active
Slave
—
2
—
ns
151
SS deassertion to data high impedance
Slave
—
9
—
9
ns
152
SCK edge to data out valid (data out delay
time)
Master/
Slave
Bypassed
Narrow
Wide
2
×T
C+33
2
×T
C+123
2
×T
C+210
—
53
143
230
ns
153
SCK edge to data out not valid
(data out hold time)
Master/
Slave
Bypassed
Narrow
Wide
TC+5
TC+55
TC+106
15
65
116
—
ns
154
SS assertion to data out valid (CPHA = 0)
Slave
—
TC+33
—
43
ns
157
First SCK sampling edge to HREQ output
deassertion
Slave
Bypassed
Narrow
Wide
2.5
×T
C+30
2.5
×T
C+120
2.5
×T
C+217
—
55
145
242
ns
158
Last SCK sampling edge to HREQ output
not deasserted (CPHA = 1)
Slave
Bypassed
Narrow
Wide
2.5
×T
C+30
2.5
×T
C+80
2.5
×T
C+136
55
105
161
—
ns
Table 3-21 Serial Host Interface SPI Protocol Timing (continued)
No.
Characteristics
Mode
Filter Mode
Expression
100MHz
Unit
Min
Max
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PDF描述 |
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