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参数资料
| 型号： | DSPB56362AG120 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 77/152页 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT AUD 120MHZ 144-LQFP |
| 标准包装： | 60 |
| 系列： | DSP56K/Symphony |
| 类型： | 音频处理器 |
| 接口： | 主机接口，I²C，SAI，SPI |
| 时钟速率： | 120MHz |
| 非易失内存： | ROM（126 kB） |
| 芯片上RAM： | 42kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 3.30V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 144-LQFP |
| 供应商设备封装： | 144-LQFP（20x20） |
| 包装： | 托盘 |
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Internal Clocks
DSP56362 Technical Data, Rev. 4
3-4
Freescale Semiconductor
3.6
Internal Clocks
Table 3-4 Internal Clocks, CLKOUT
Characteristics
Symbol
Expression1
, 2
1 DF = Division Factor
Ef = External frequency
ETC = External clock cycle
MF = Multiplication Factor
PDF = Predivision Factor
TC = internal clock cycle
2 See the PLL and Clock Generation section in the DSP56300 Family Manual for a detailed discussion of the PLL.
Min
Typ
Max
Internal operation frequency and CLKOUT
with PLL enabled
f—
(Ef
× MF)/(PDF × DF)
—
Internal operation frequency and CLKOUT
with PLL disabled
f—
Ef/2
—
Internal clock and CLKOUT high period
With PLL disabled
With PLL enabled and MF
≤ 4
With PLL enabled and MF > 4
TH
—
0.49
× ET
C × PDF ×
DF/MF
0.47
× ET
C × PDF ×
DF/MF
ETC
—
0.51
× ET
C × PDF ×
DF/MF
0.53
× ET
C × PDF ×
DF/MF
Internal clock and CLKOUT low period
With PLL disabled
With PLL enabled and MF
≤ 4
With PLL enabled and MF > 4
TL
—
0.49
× ET
C × PDF ×
DF/MF
0.47
× ET
C × PDF ×
DF/MF
ETC
—
0.51
× ET
C × PDF ×
DF/MF
0.53
× ET
C × PDF ×
DF/MF
Internal clock and CLKOUT cycle time with
PLL enabled
TC
—ETC × PDF × DF/MF
—
Internal clock and CLKOUT cycle time with
PLL disabled
TC
—2
× ET
C
—
Instruction cycle time
ICYC
—TC
—
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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