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参数资料
| 型号： | PEF22508E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封装： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件页数： | 141/193页 |
| 文件大小： | 10683K |
| 代理商： | PEF22508E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页当前第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页
Data Sheet
51
Rev. 1.0, 2005-06-02
OctalLIU
TM
PEF 22508 E
Functional Description
Masked Interrupts Visible in Status Registers
The “Global” Interrupt Status register (GIS) indicates those interrupt status registers with active interrupt
indications (bits GIS.ISR(7:0)).
An additional interrupt mode can be selected per port via bit GCR.VIS (GCR). In this mode, masked interrupt
status bits neither generate an interrupt on pin INT nor are they visible in GIS, but are displayed in the
corresponding interrupt status registers ISR(1:4), ISR6 and ISR7.
PLL Interrupt Status Register
The bit n (n = 1 to 8) of the register CIS pointers an interrupt on channel n.
The Global Interrupt Status register GIS2 indicates the lock status of the (global) PLL. Masking can be done
by the register GIMR.
An additional interrupt mode can be selected per port via bit IPC.VISPLL (IPC) where the masked interrupt
status bit GIS2.PLLLS does not generate an interrupt on pin INT, but is displayed in the corresponding
interrupt status register bit GIS2.PLLLC.
The additional interrupt mode is useful when some interrupt status bits are to be polled in the individual interrupt
status registers.
Note:
1. In the visible mode, all active interrupt status bits, whether the corresponding actual interrupt is masked or not,
are reset when the interrupt status register is read. Thus, when polling of some interrupt status bits is desired,
care must be taken that unmasked interrupts are not lost in the process.
2. All unmasked interrupt statuses are treated as before.
Please note that whenever polling is used, all interrupt status registers concerned have to be polled individually
(no “hierarchical” polling possible), since GIS only contains information on actually generated, i.e. unmasked
interrupts.
3.5.4
Boundary Scan Interface
In the OctalLIU
TM a Test Access Port (TAP) controller is implemented. The essential part of the TAP is a finite state
machine (16 states) controlling the different operational modes of the boundary scan. Both, TAP controller and
boundary scan, meet the requirements given by the JTAG standard IEEE 1149.1-2001. Figure 15 gives an
overview, Figure 41 shows the timing diagram and Table 52 gives the appropriate values of the timing
parameters.
Table 9
Interrupt Modes
GCR.VIS; IPC.VISPLL
Appropriate Mask bit
Interrupt active
Visibility in ISR(1:4),
ISR(6:7) and GIS2
0
yes
0
1
no
1
0
yes
1
no
yes
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PDF描述 |
|---|---|
| PEF22554E | DATACOM, FRAMER, PBGA160 |
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参数描述 |
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