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参数资料
| 型号： | PEF22508E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封装： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件页数： | 28/193页 |
| 文件大小： | 10683K |
| 代理商： | PEF22508E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页当前第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页
Data Sheet
123
Rev. 1.0, 2005-06-02
OctalLIUTM
PEF 22508 E
Register Description
Registers PC2 to PC3 have the same layout and description, but the 4 LSBs of PC3 are not used because only 2
MFPs in transmit direction exists.
The bits (3:0) of the register PC3 can be written and read, but are not valid.
Only one of the ports RPA, RPB or RPC must be configured as RTDMT.
Only one of the ports XPA or XPB must be configured as XLT or XLT.
The registers PC1, PC2 and PC4 have the reset values 00H, PC3 has the reset value F0H.
The Offset Addresses are listed in PCn Overview, for bit names refer to Port Configuration Registers.
TCLK: Transmit Clock (Input)
A 2.048/8.192 MHz clock has to be sourced by the system if the internal generated transmit
clock (DCO-X) is not used. Optionally this input is used as a synchronization clock for the
DCO-X circuitry with a frequency of 2.048 MHz.
0011B
reserved
0100B
reserved
0101B
reserved
0110B
XCLK: Transmit Line Clock (Output)
Frequency: 2.048 MHz
0111B
XLT: Transmit Line Tristate control input, high active
With a high level on this port the transmit lines XL1/2 or XDOP/N are set directly into tristate.
This pin function is logically ORd with register XPM2.XLT. See Chapter 3.9.1.
1000B
GPI: General Purpose Input, low level
Value of this input is stored in register MFPI.
1001B
GPOH: General Purpose Output, high level
Pin is set fixed to high level
1010B
GPOL: General Purpose Output, low level
Pin is set fixed to low level
1011B
reserved
1100B
XDIN: Transmit Data In Negative
Negative transmit data in for dual rail mode
1101B
XLT: Transmit Line Tristate control input, low active
see XLT
1110B
reserved
1111B
Table 43
PCn Overview
Register Short Name
Register Long Name
Offset Address
Page Number
PC2
Port Configuration Register 2
xx81H
PC3
Port Configuration Register 3
xx82H
Table 44
Port Configuration Registers
7
6
5
4
3
2
1
0
PC1
RPC13
RPC12
RPC11
RPC10
XPC13
XPC12
XPC11
XPC10
PC2
RPC23
RPC22
RPC21
RPC20
XPC23
XPC22
XPC21
XPC20
PC3
RPC33
RPC32
RPC31
RPC30
XPC33
XPC32
XPC31
XPC30
Table 42
XPC1 Constant Values (cont’d)
Name and Description
Value
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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