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参数资料
| 型号： | PEF22508E |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封装： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件页数： | 94/193页 |
| 文件大小： | 10683K |
| 代理商： | PEF22508E |
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Data Sheet
183
Rev. 1.0, 2005-06-02
OctalLIU
TM
PEF 22508 E
Operational Description
Features like alarm simulation etc. are activated later. Transmission of alarms (e.g. AIS, remote alarm) and control
of synchronization in connection with consequent actions to remote end and internal system depend on the
activation procedure selected.
Note: Read access to unused register addresses: value should be ignored. Write access to unused register
addresses: should be avoided, or set to “00” hex. All control registers (except XS(16:1), CMDR, DEC) are of
type Read/Write.
Specific E1 Register Settings
The following is a suggestion for a basic configuration to meet most of the E1 requirements. Depending on different
applications and requirement any other configuration can be used.
Attention: After the device configuration a software reset should be executed by setting of bits
CMDR.XRES/RRES.
7.5
Device Configuration in T1/J1 Mode
After reset, the OctalLIU
TM is initialized for E1 doubleframe format. To configure T1/J1 mode, bit MR1.PMOD has
to be set high. After the internal clocking is settled to T1/J1mode (takes up to 20
s), the following register values
are initialized:
T1/J1 Initialization
For a correct start up of the primary access interface a set of parameters specific to the system and hardware
environment must be programmed after RES goes inactive (high). Both the basic and the operational parameters
Table 69
Configuration Parameters (E1)
Basic Set Up
Master clocking mode
GCM(6:1) according to external MCLK clock frequency
E1 mode select
MR1.PMOD = 0
Clock system configuration
CMR(3:1), GPC1; if COMP = 0 CMR(6:4) and
GPC(6:2)
Specification of line interface
LIM0, LIM1, XPM(2:0)
Specification of transmit pulse mask
XPM(2:0) or TXP(16:1)
Line interface coding
MR0.XC(1:0), MR0.RC(1:0)
Loss-of-signal detection/recovery conditions
PCD, PCR, LIM1, LIM2
Multi Function Port selection
PC(3:1)
Table 70
Line Interface Configuration (E1)
MR2.DAIS = 1
Disables AIS insertion into the data stream (necessary for proper operation)
MR2.RTM = 1
Sets the receive dual elastic store in a “free running” mode (necessary for proper
operation)
MR5.TT0 = 1
Enables transmit transparent mode (necessary for proper operation)
MR5.XTM = 1
Sets the transmitter in a “free running” mode (necessary for proper operation)
MR0.XC0/
MR0.RC0/
LIM1.DRS
MR3.CMI
The OctalLIU
TM supports requirements for the analog line interface as well as the
digital line interface. For the analog line interface the codes AMI and HDB3 are
supported. For the digital line interface modes (dual- or single-rail) the OctalLIU
TM
supports AMI, HDB3, CMI (with and without HDB3 precoding).
PCD = 0A
H
LOS detection after 176 consecutive “zeros” (fulfills G.775).
PCR = 15
H
LOS recovery after 22 “ones” in the PCD interval. (fulfills G.775).
LIM1.RIL(2:0) = 02
H
LOS threshold of 0.6 V (fulfills G.775).
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