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参数资料
| 型号： | SPEAR-07-NC03 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PBGA180 |
| 封装： | LEAD FREE, 12 X 12 MM, 1.70 MM HEIGHT, LFBGA-180 |
| 文件页数： | 150/194页 |
| 文件大小： | 1987K |
| 代理商： | SPEAR-07-NC03 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页当前第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页
Obsolete
Product(s)
- Obsolete
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Product(s)
SPEAR-07-NC03
6 Blocks description
59/194
6.2.4.27 Flow Control register
Mnemonic
: FCR
Address
: 0x3000_341C
Default value
: 0x0000_0000
This register is used to control the generation and reception of the Control (PAUSE Command)
frames by the MAC's Flow control block. A write to register with busy bit set to '1' triggers the
Flow Control block to generate a Control frame. The fields of the control frame are selected as
specified in the 802.3x specification and PauseTime value from this register is used in the
"Pause Time" field of the control frame. The Busy bit is set until the control frame is transferred
onto the cable. The Host has to make sure that the Busy bit is cleared before writing the
register. The Pass Control Frames bit indicates the MAC whether to pass the control frame to
the Host or not and Flow Control Enable bit enables the receive portion of the Flow Control
block.
PTIME
: Pause Time. This field tells the value that is to be used in the PAUSE TIME field in the
control frame.
PCF
: Pass Control Frames. When set, the control frames are passed to the Host. The MAC110
core will decode the control frame (PAUSE), disables the transmitter for the specified amount of
time. The Control Frame bit in the Receive Status (bit 25) is set and Transmitter Pause Mode
signal indicates the current state of the MAC Transmitter.
When reset, the MAC110 core will decode the control frames but will not pass the frames to the
Host. The Control Frame bit in the Receive Status (bit 25) will be set and the Transmitter Pause
Mode signal gives the current status of the Transmitter, but the Packet Filter bit in the Receive
Status is reset indication the application to flush the frame.
FCE
: Flow Control Enable. When set, the MAC is enabled for operation and it will decode all the
incoming frames for control frames. When the MAC receives a valid control frame (PAUSE
command), it will disable the transmitter for the specified time.
When reset, the operation in the MAC is disabled and the MAC does not decode the frames for
control frames.
Note:
Flow Control is applicable when the MAC110 is set in Full Duplex Mode. In Half Duplex mode,
this bit will enable using Backpressure to control flow of transmitted frames to the MAC110.
FCB
: Flow Control Busy. This bit should read a logic 0 before writing to the Flow Control
register. To initiate a PAUSE control frame the host must set this bit to '1'. During a transfer of
Control Frame, this bit will continue to be set to signify that a frame transmission is in progress.
After the completion of the transmission of the PAUSE control frame, the MAC will reset to '0'.
The Flow Control register should not be written to until this bit is cleared.
Bit
Field name
Access
31 - 16
PTIME
RW
15 - 03
Reserved
RO
02
PCF
RW
01
FCE
RW
00
FCB
RW
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