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参数资料
| 型号： | SPEAR-07-NC03 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PBGA180 |
| 封装： | LEAD FREE, 12 X 12 MM, 1.70 MM HEIGHT, LFBGA-180 |
| 文件页数： | 159/194页 |
| 文件大小： | 1987K |
| 代理商： | SPEAR-07-NC03 |
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SPEAR-07-NC03
6 Blocks description
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enabled), until the CPU finally sets its VALID bit to on. Since the DMA transfer practically never
ends, note that in this case the TX_DONE interrupt bit is never raised.
With this approach every Descriptor will have the DMA_NEXT field pointing to the next
Descriptor in the chain (the last one will point the first one), the NXT_EN bit, the VALID bit and
the NPOL_EN bit on.
The DMA MAC will keep fetching the Descriptor one by one until it finds one with its VALID bit
set to 0. Every time the DMA MAC completes a Descriptor (frame) it saves the Transfer Status
into the TxRx_STATUS, ot turns its VALID bit to off and raises the TX_CURR_DONE interrupt
bit.
6.2.5.7 Frame Reception (Rx)
The frame reception process is something that needs to be activated at the beginning and kept
always running. For this reason the closed Descriptor list (see above) is much more useful than
the open list approach.
Again, with this approach every Descriptor will have the DMA_NEXT field pointing to the next
Descriptor in the chain (the last one will point to the first one), the NXT_EN bit, the VALID bit
and the NPOL_EN bit on.
The CPU starts the transfer activity loading the DMA Next register of the DMA MAC with the
physical location of the first Descriptor and sets the DMA_START register enable bit to on. The
DMA MAC will start fetching the Descriptors one by one, driven by the frame reception from the
line. Every time the DMA MAC completes a Descriptor (frame) it saves the transfer status into
the TxRx_STATUS, it turns its VALD bit to off and raises the RX_CURR_DONE interrupt bit.
Eventually, if the DMA MAC will be faster then the CPU, it will wrap around the Descriptor chain
finding a Descriptor still invalid.
Then the DMA MAC keeps polling the invalid Descriptor, raising each time the RX_NEXT
interrupt bit (if enabled), until some Descriptors gets available (note that in this case some
frame could be lost). In the meantime the CPU should consume the frames received and set
the VALID bit to on of all the Descriptor released.
As soon as the DMA finds the Descriptor valid again, it will be able to complete the transfer and
fetch the next Descriptor.
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PDF描述 |
|---|---|
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| SPL2F85 | FIBER OPTIC LASER DIODE EMITTER, 840-860nm, PANEL MOUNT, TO-220, FC CONNECTOR |
| SPL2Y81-2S | 808 nm, LASER DIODE |
| SPLC-35-FE-BX-CDFA | FIBER OPTIC TRANSCEIVER, 1260-1360nm, 125Mbps(Tx), 125Mbps(Rx), SURFACE MOUNT, LC CONNECTOR |
相关代理商/技术参数 |
参数描述 |
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| SPEAR-09-H022 | 制造商:STMicroelectronics 功能描述: |
| SPEAR-09-H022_06 | 制造商:STMICROELECTRONICS 制造商全称:STMicroelectronics 功能描述:SPEAr Head200 ARM 926, 200K customizable eASIC gates, large IP portfolio SoC |
| SPEAR-09-H042 | 制造商:STMICROELECTRONICS 制造商全称:STMicroelectronics 功能描述:SPEAr⑩ Head200, ARM 926, 200 K customizable eASIC⑩ gates, large IP portfolio SoC |
| SPEAR-09-H122 | 制造商:STMICROELECTRONICS 制造商全称:STMicroelectronics 功能描述:SPEAr⑩ Head600 |
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