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参数资料
| 型号： | SPEAR-07-NC03 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PBGA180 |
| 封装： | LEAD FREE, 12 X 12 MM, 1.70 MM HEIGHT, LFBGA-180 |
| 文件页数： | 5/194页 |
| 文件大小： | 1987K |
| 代理商： | SPEAR-07-NC03 |
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Obsolete
Product(s)
- Obsolete
Product(s)
Obsolete
Product(s)
- Obsolete
Product(s)
6 Blocks description
SPEAR-07-NC03
102/194
6.4.6
DMA Registers
All The DMA registers are 32 bit wide.
6.4.6.1 DMA Status and Control Register
Address
0x2200_0000
Default value 0x
TX_FIFOSIZE
: Size of transmitter data path FIFO.
●
0001: 2 * 32 BIT WORDS
TX_IO_DATA_WIDTH
: Width of the I/O bus transmit data path
●
00: 8-bit
TX_CHAN_STATUS
: provides information about the TX channel structure
●
01: Low End TX Channel (No DMA descriptor fetch)
RX_FIFOSIZE
: Size of receiver data path FIFO.
●
0001: 2 * 32 BIT WORDS
RX_IO_DATA_WIDTH
: Width of the I/O bus receive data path
●
00: 8-bit
RX_CHAN_STATUS
: provides information about the RX channel structure
●
01: Low End RX Channel (No DMA descriptor fetch)
REVISION
: Revision of the DMA
●
????????
LOOPB
: Set to '1' to enable the loop-back mode. When set the RX DMA data are extracted by
the TX FIFO and pushed in the RX one.
SRESET
: DMA soft reset, set to '1' to put the whole DMA logic in reset condition.
This signal has no effect on the AHB interface so the whole DMA will be reset only when the
last AHB transfer is finished.
Bit
Field name
Access
31 - 28
TX_FIFO _SIZE
RO
27 - 26
TX_IO_DATA_WIDTH
RO
25 - 24
TX_CHAN_STATUS
RO
23 - 20
RX_FIFO_SIZE
RO
19 - 18
RX_IO_DATA_WIDTH
RO
17 - 16
RX_CHAN_STATUS
RO
15 - 08
REVISION
RO
07 - 04
Reserved
RO
03 - 02
Reserved
RO
01
LOOPB
RW
00
SRESET
RW
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