参数资料
| 型号： | XCV405E-6FG676I |
| 厂商： | Xilinx Inc |
| 文件页数： | 104/118页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 1.8V 676-BGA |
| 产品变化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 标准包装： | 1 |
| 系列： | Virtex®-E EM |
| LAB/CLB数： | 2400 |
| 逻辑元件/单元数： | 10800 |
| RAM 位总计： | 573440 |
| 输入/输出数： | 404 |
| 门数： | 129600 |
| 电源电压： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 676-BGA |
| 供应商设备封装： | 676-FBGA（27x27） |
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Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays
Module 4 of 4
DS025-4 (v3.0) March 21, 2014
10
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
BG560 Differential Pin Pairs
Virtex-E Extended Memory devices have differential pin
pairs that can also provide other functions when not used as
a differential pair. A
√ in the AO column indicates that the pin
pair can be used as an asynchronous output for all devices
provided in this package.
Pairs with a note number in the AO column are device
dependent. They can have asynchronous outputs if the pin
pair is in the same CLB row and column in the device. Num-
bers in this column refer to footnotes that indicate which
devices have pin pairs that can be asynchronous outputs.
The Other Functions column indicates alternative func-
tion(s) not available when the pair is used as a differential
pair or differential clock.
Table 2:
BG560 Package Differential Pin Pair Summary
XCV405E and XCV812E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
Global Differential Clock
3
0
A17
C18
NA
IO LVDS 21
2
1
D17
E17
NA
IO LVDS 21
1
5
AJ17
AM18
NA
IO LVDS 115
0
4
AL17
AM17
NA
IO LVDS 115
IO LVDS
Total Outputs: 183, Asyncronous Outputs: 79
0
D29
E28
NA
-
10
A31
D28
√
-
20
C29
E27
√
VREF_0
30
D27
B30
1
-
40
B29
E26
√
-
50
C27
D26
√
VREF_0
60
A28
E25
NA
-
70
C26
D25
1
-
80
B26
E24
1
VREF_0
90
D24
C25
1
-
100A25
E23
√
VREF_0
110B24
D23
√
-
12
0
C23
E22
NA
-
13
0
D22
A23
√
-
140B22
E21
√
VREF_0
15
0
C21
D21
1
-
160E20
B21
√
-
17
0
C20
D20
√
VREF_0
180E19
B20
NA
-
19
0
C19
D19
1
-
20
0
D18
A19
1
VREF_0
21
1
E17
C18
NA
GCLK LVDS 3/2
221B17
C17
1
-
23
1
D16
B16
1
VREF_1
24
1
C16
E16
1
-
25
1
C15
A15
NA
-
261E15
D15
√
VREF_1
27
1
D14
C14
√
-
281E14
A13
1
-
29
1
D13
C13
√
VREF_1
301E13
C12
√
-
31
1
D12
A11
NA
-
32
1
C11
B11
√
-
33
1
D11
B10
√
VREF_1
34
1
A9
C10
2
-
35
1
D10
C9
1
VREF_1
36
1
B8
A8
1
-
37
1
C8
E10
NA
-
38
1
A6
B7
√
VREF_1
39
1
D8
C7
√
-
40
1
B5
A5
2
-
41
1
D7
C6
√
VREF_1
42
1
B4
A4
√
-
43
1
E7
C5
NA
-
44
1
A2
D6
√
CS
45
2
D4
E4
√
DIN_D0
46
2
F5
B3
2
-
47
2
F4
C1
NA
-
48
2
G5
E3
1
VREF_2
49
2
D2
G4
1
-
Table 2:
BG560 Package Differential Pin Pair Summary
XCV405E and XCV812E
相关PDF资料 |
PDF描述 |
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参数描述 |
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