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参数资料
| 型号： | AD73522 |
| 厂商： | Analog Devices, Inc. |
| 英文描述： | Dual Analog Front End with Flash based DSP Microcomputer(带闪速DSP微计算机的双模拟前端) |
| 中文描述： | 双模拟前端与闪存的DSP微机（带闪速DSP的微计算机的双模拟前端） |
| 文件页数： | 3/46页 |
| 文件大小： | 654K |
| 代理商： | AD73522 |
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AD73522
–3–
REV. PrC 05/99
Prelimnary Technical Data
PRELMNARY
DATA
TECHNCAL
input section allows direct connection to the internal
Programmable Gain Amplifier at the input of the sigma-delta
ADC section or optional inverting amplifiers may be
configured to provide some fixed external gain or to interface
to a transducer with relatively high source impedance. T he
input section also features programmable differential channel
inversion and configuration of the the differential input as
two separate single-ended inputs. T he ADC features a second
order sigma-delta modulator which samples at MCLK /8. Its
bitstream output is filtered and decimated by a Sinc-cubed
decimator to provide a sample rate selectable from 64 kHz, 32
kHz, 16 kHz or 8 kHz (based on an MCLK of 16.384 MHz).
T he DAC channel features a Sinc-cubed interpolator which
increases the sample rate from the selected rate to the digital
sigma-delta modulator rate of MCLK /8. T he digital sigma-
delta modulator’s output bit-stream is fed to a single-bit DAC
whose output is reconstructed/filtered by two stages of low-
pass filtering (switched capacitor and continuous time) before
being applied to the differential output driver.
Each channel also features two programmable gain elements,
Analog Gain T ap (AGT ) and Digital Gain T ap (DGT ),
which, when enabled, add a signed and scaled amount of the
input signal to the DAC’s output signal. T his is of particular
use in line impedance balancing when interfacing the AFE to
Subscriber Line Interface Circuits (SLICs).
VINN1
VINP1
VFBN1
VFBP1
VREF
VOUTP1
VOUTN1
Continuous
Time
Low-Pass
Filter
+6/-15dB
PGA
VREF
Analog
Loopback
select
Single-Ended
Enable
Invert
Inverting Op-
amps
Analog
Gain Tap
Gain
+/- 1
0/38 dB
PGA
REFOUT
REFCAP
Reference
Figure 3: Analog Front End Configuration
+
+
VINN1
VINP1
VFBN1
VFBP
1
VREF
Analog
Sigma-Delta
Modulator
+
0/38dB
PGA
VOUTP1
VOUTN1
Continuous
Time
Low-Pass
Filter
+6/-15dB
PGA
+
Switched-
Capacitor
Low Pass Filter
Interpolator
Digital
Sigma-Delta
Modulator
1-Bit
DAC
+
GAIN
+/- 1
-
+
+
-
-
GAIN
+/- 1
Decimator
SDI
SDIFS
SCLK2
Seria
l
I/O
Port
REFCAP
REFOUT
Reference
SE
RESETC
SDOFS
SDO
MCLK
+
+
VINN2
VINP2
VFBN2
VFBP2
VREF
Analog
Sigma-Delta
Modulator
-
+
0/38dB
PGA
VOUTP2
VOUTN2
Continuous
Time
Low-Pass
Filter
+6/-15dB
PGA
+
Switched-
Capacitor
Low Pass Filter
Interpolator
Digital
Sigma-Delta
Modulator
DAC
+
+
-
-
GAIN
+/- 1
Decimator
+
+/- 1
-
Invert
Single-Ended
Enable
Analog
Loop
Back
Invert
Single-Ended
Enable
Analog
Loop
Back
Figure 2: Functional Block Diagram of Analog Front End
Section
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