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参数资料
| 型号： | ADUC834BSZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 68/80页 |
| 文件大小： | 0K |
| 描述： | IC ADC DUAL16/24BIT W/MCU 52MQFP |
| 产品培训模块： | Process Control |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC8xx |
| 核心处理器： | 8052 |
| 芯体尺寸： | 8-位 |
| 速度： | 12.58MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | POR，PSM，PWM，温度传感器，WDT |
| 输入/输出数： | 34 |
| 程序存储器容量： | 62KB（62K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 2.25K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.25 V |
| 数据转换器： | A/D 3x16b，4x24b; D/A 1x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 52-QFP |
| 包装： | 托盘 |
| 产品目录页面： | 738 (CN2011-ZH PDF) |
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REV. A
–70–
ADuC834
TIMING SPECIFICATIONS1, 2, 3
(AVDD = 2.7 V to 3.6 V or 4.75 V to 5.25 V, DVDD = 2.7 V to 3.6 V or 4.75 V to 5.25 V;
all specifications TMIN to TMAX, unless otherwise noted.)
32.768 kHz External Crystal
Parameter
Min
Typ
Max
Unit
Figure
CLOCK INPUT (External Clock Driven XTAL1)
tCK
XTAL1 Period
30.52
s69
tCKL
XTAL1 Width Low
6.26
s69
tCKH
XTAL1 Width High
6.26
s69
tCKR
XTAL1 Rise Time
9
s69
tCKF
XTAL1 Fall Time
9
s69
1/tCORE
ADuC834 Core Clock Frequency
4
0.098
12.58
MHz
tCORE
ADuC834 Core Clock Period
5
0.636
s
tCYC
ADuC834 Machine Cycle Time
6
0.95
7.6
122.45
s
NOTES
1AC inputs during testing are driven at DV
DD – 0.5 V for a Logic 1, and 0.45 V for a Logic 0. Timing measurements are made at V IH min for a Logic 1, and VIL max
for a Logic 0 as shown in Figure 70.
2For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to float when a 100 mV change from the
loaded VOH/VOL level occurs as shown in Figure 70.
3C
LOAD for Port0, ALE, PSEN outputs = 100 pF; CLOAD for all other outputs = 80 pF unless otherwise noted.
4ADuC834 internal PLL locks onto a multiple (384 times) the external crystal frequency of 32.768 kHz to provide a stable 12.583 MHz internal clock for the system.
The core can operate at this frequency or at a binary submultiple called Core_Clk, selected via the PLLCON SFR.
5This number is measured at the default Core_Clk operating frequency of 1.57 MHz.
6ADuC834 Machine Cycle Time is nominally defined as 12/Core_Clk.
t
CKH
t
CKL
t
CK
t
CKF
t
CKR
Figure 69. XTAL1 Input
DVDD – 0.5V
0.45V
0.2DVDD + 0.9V
TEST POINTS
0.2DVDD – 0.1V
VLOAD – 0.1V
VLOAD
VLOAD + 0.1V
TIMING
REFERENCE
POINTS
VLOAD – 0.1V
VLOAD
VLOAD + 0.1V
Figure 70. Timing Waveform Characteristics
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