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参数资料
| 型号： | HSP50214BVCZ |
| 厂商： | Intersil |
| 文件页数： | 59/62页 |
| 文件大小： | 0K |
| 描述： | IC DOWNCONVERTER 14BIT 120-MQFP |
| 标准包装： | 24 |
| 功能： | 降频器 |
| RF 型： | AMPS，CDMA，GSM，TDMA |
| 封装/外壳： | 120-BQFP |
| 包装： | 托盘 |
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HSP50214B
AC Electrical Specifications
V CC = 5 ± 5%, T A = 0 ° to +70 ° C, Commercial (Note 7); -40 ° C to +85 ° C, Industrial (Note 7) (Continued)
65MHz
PARAMETER
Hold Time GAINADJ(2:0), IN(13:0), ENI, COF, COFSYNC, and SYNCIN1
SYMBOL
t DH
MIN
0
MAX
-
UNITS
ns
from CLKIN
Setup Time AGCGNSEL, SOF, MCSYNCI, SOFSYNC, and SYNCIN2 to
t DSS
7
-
ns
PROCCLK
Hold Time AGCGNSEL, SOF, MCSYNCI, SOFSYNC, and SYNCIN2
t DHS
0
-
ns
from PROCCLK
Setup Time, A(2:0) to Rising Edges of WR
Setup Time, A(2:0) C(7:0) to Rising Edges of WR
Hold Time, A(2:0) from Rising Edges of WR
Hold Time, A(2:0) C(7:0) from Rising Edges of WR
WR to CLKIN
t WSA
t WSC
t WHA
t WHC
t WC
8
10
2
0
14
-
-
-
-
-
ns
ns
ns
ns
ns
(Note 9)
PROCCLK to AOUT(15:0), BOUT (15:0), DATARDY, SEROUTA,
t DO_OUT
-
8
ns
SEROUTB, INTRRP
PROCCLK to SYNCOUT
PROCCK to MCSYNCO
PROCCLK to SERCLK, SERSYNC Valid
WR High
WR Low
RD Low
Address Setup to Read Low
RD LOW to Data Valid
RD HIGH to Output Disable
t DO_SYNCI
t DO_SYNCO
t DOS
t WRH
t WRL
t RL
t AS
t RDO
t ROD
-
-
-
15
8
20
-
-
-
8
6
12
-
-
-
3
18
10
ns
ns
ns
ns
ns
ns
ns
ns
ns
(Note 8)
Output Enable Time
Output Enable Time - FIFO Read Mode
Output Disable Time
t OE
t OEBL
t OD
-
-
-
6
15
8
ns
ns
ns
(Note 8)
Output Rise, Fall Time
t RF
-
3
ns
(Note 8)
NOTES:
7. AC tests performed with C L = 40pF, I OL = 2mA, and I OH = -400 μ A. Input reference level for CLK is 2.0V, all other inputs 1.5V.
Test V IH = 3.0V, V IHC = 4.0V, V IL = 0V.
8. Controlled via design or process parameters and not directly tested. Characterized upon initial design and at major process or design changes.
9. Setup time required to ensure action initiated by WR will be seen by a particular CLKIN.
59
FN4450.4
May 1, 2007
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