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参数资料
| 型号： | IDT82P2828BHG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 23/154页 |
| 文件大小： | 0K |
| 描述： | IC LIU T1/J1/E1 28+1CH 640-PBGA |
| 标准包装： | 5 |
| 类型： | 线路接口装置（LIU） |
| 规程： | E1 |
| 电源电压： | 3.13 V ~ 3.47 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 640-BGA 裸露焊盘 |
| 供应商设备封装： | 640-PBGA-EP（31x31） |
| 包装： | 托盘 |
| 其它名称： | 82P2828BHG |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页当前第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页
IDT82P2828
28(+1) CHANNEL HIGH-DENSITY T1/E1/J1 LINE INTERFACE UNIT
Programming Information
119
February 6, 2009
JM - Jitter Measurement Configuration For Channel 0 Register
JIT_PL - Positive Peak Jitter Measurement Low-Byte Register
JIT_PH - Positive Peak Jitter Measurement High-Byte Register
Address: 7E5H
Type: Read / Write
Default Value: 00H
Bit
Name
Description
7 - 3
-
Reserved.
2
JM_STOP
This bit is valid only when the JM_MD bit (b1, JM) is ‘0’.
A transition from ‘0’ to ‘1’ on this bit updates the JIT_PH, JIT_PL and JIT_NH, JIT_NL registers.
This bit must be cleared before the next round.
1
JM_MD
This bit selects the jitter measurement period.
0: The period is determined manually by setting the JM_STOP bit (b2, JM). (default)
1: The period is one second automatically.
0
JM_BW
This bit selects the bandwidth of the measured jitter.
0: 10 Hz ~ 40 KHz (in T1/J1 mode) / 20 Hz ~ 100 KHz (in E1 mode). (default)
1: 8 KHz ~ 40 KHz (in T1/J1 mode) / 18 KHz ~ 100 KHz (in E1 mode).
Address: 7E6H
Type: Read
Default Value: 00H
Bit
Name
Description
7 - 0
JIT_P[7:0]
These bits, together with the JIT_P[11:8] bits, reflect the greatest positive peak value of the demodulated jitter signal which is
measured by channel 0. They are updated automatically or manually, as determined by the JM_MD bit (b1, JM). They should be
read in the next round of jitter measurement; otherwise, they will be overwritten.
The relationship between the greatest positive peak value and the indication in these bits is:
Positive Peak = [JIT_PH, JIT_PL] / 16 (UIpp)
Address: 7E7H
Type: Read
Default Value: 00H
Bit
Name
Description
7 - 4
-
Reserved.
3 - 0
JIT_P[11:8]
(Refer to the description of the JIT_PL register.)
76
54
3
2
1
0
--
-
JM_STOP
JM_MD
JM_BW
7
654
321
0
JIT_P7
JIT_P6
JIT_P5
JIT_P4
JIT_P3
JIT_P2
JIT_P1
JIT_P0
76
54
3
2
1
0
-
JIT_P11
JIT_P10
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JIT_P8
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