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参数资料
| 型号： | IDT82P2828BHG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 54/154页 |
| 文件大小： | 0K |
| 描述： | IC LIU T1/J1/E1 28+1CH 640-PBGA |
| 标准包装： | 5 |
| 类型： | 线路接口装置（LIU） |
| 规程： | E1 |
| 电源电压： | 3.13 V ~ 3.47 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 640-BGA 裸露焊盘 |
| 供应商设备封装： | 640-PBGA-EP（31x31） |
| 包装： | 托盘 |
| 其它名称： | 82P2828BHG |
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IDT82P2828
28(+1) CHANNEL HIGH-DENSITY T1/E1/J1 LINE INTERFACE UNIT
Physical And Electrical Specifications
147
February 6, 2009
8.13.5 PARALLEL INTEL MULTIPLEXED MICROPROCESSOR INTERFACE
8.13.5.1Read Cycle Specification
Figure-68 Parallel Intel Multiplexed Microprocessor Interface Read Cycle
Symbol
Parameter
Min
MAX
Units
tAEW
Valid ALE signal width
5
ns
tRSW
Valid read signal width
36 (T1/J1) / 33 (E1) or wait until RDY activated
ns
tCSD
Valid RD + CS falling edge delay after ALE falling edge
0
ns
tVAS
Valid address to ALE setup time
5
ns
tVAH
Valid address to ALE hold time
5
ns
tPRD
Data propagation delay after valid read signal falling edge
31 (T1/J1) / 28 (E1)
ns
tZRD
Valid read negated to output High-Z before valid ALE rising edge
5
20
ns
RD + CS
D[7:0]
Valid Data
tZRD
tRSW
tPRD
Note: WR shall be tied to high.
RDY
tAEW
tCSD
ALE
Valid address
tVAS
tVAH
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