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参数资料
| 型号： | LFEC10E-5FN256C |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 中文描述： | FPGA, 1280 CLBS, 10200 GATES, 420 MHz, PBGA256 |
| 封装： | 17 X 17 MM, LEAD FREE, FPBGA-256 |
| 文件页数： | 112/478页 |
| 文件大小： | 12564K |
| 代理商： | LFEC10E-5FN256C |
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March 2010
2010 Lattice Semiconductor Corp. All Lattice trademarks, registered trademarks, patents, and disclaimers are as listed at www.latticesemi.com/legal. All other brand
or product names are trademarks or registered trademarks of their respective holders. The specifications and information herein are subject to change without notice.
www.latticesemi.com
1
Section I. LatticeECP/EC Family Data Sheet
Introduction
Features ............................................................................................................................................................. 1-1
Introduction ........................................................................................................................................................ 1-2
Architecture
Architecture Overview ........................................................................................................................................ 2-1
PFU and PFF Blocks.......................................................................................................................................... 2-3
Slice .......................................................................................................................................................... 2-3
Routing............................................................................................................................................................... 2-7
Clock Distribution Network ................................................................................................................................. 2-7
Primary Clock Sources.............................................................................................................................. 2-7
Secondary Clock Sources......................................................................................................................... 2-8
Clock Routing............................................................................................................................................ 2-8
sysCLOCK Phase Locked Loops (PLLs) .................................................................................................. 2-9
Dynamic Clock Select (DCS) ........................................................................................................................... 2-11
sysMEM Memory ............................................................................................................................................. 2-12
sysMEM Memory Block........................................................................................................................... 2-12
Bus Size Matching .................................................................................................................................. 2-12
RAM Initialization and ROM Operation ................................................................................................... 2-12
Memory Cascading ................................................................................................................................. 2-13
Single, Dual and Pseudo-Dual Port Modes............................................................................................. 2-13
Memory Core Reset ................................................................................................................................ 2-13
EBR Asynchronous Reset....................................................................................................................... 2-14
sysDSP Block................................................................................................................................................... 2-14
sysDSP Block Approach Compare to General DSP ............................................................................... 2-15
sysDSP Block Capabilities ...................................................................................................................... 2-15
MULT sysDSP Element .......................................................................................................................... 2-16
MAC sysDSP Element ............................................................................................................................ 2-16
MULTADD sysDSP Element................................................................................................................... 2-17
MULTADDSUM sysDSP Element........................................................................................................... 2-18
Clock, Clock Enable and Reset Resources ............................................................................................ 2-18
Signed and Unsigned with Different Widths............................................................................................ 2-19
OVERFLOW Flag from MAC .................................................................................................................. 2-19
IPexpress............................................................................................................................................. 2-20
Optimized DSP Functions ....................................................................................................................... 2-20
Resources Available in the LatticeECP Family ....................................................................................... 2-20
DSP Performance of the LatticeECP Family........................................................................................... 2-20
Programmable I/O Cells (PIC) ......................................................................................................................... 2-21
PIO .......................................................................................................................................................... 2-22
DDR Memory Support...................................................................................................................................... 2-26
DLL Calibrated DQS Delay Block ........................................................................................................... 2-26
Polarity Control Logic .............................................................................................................................. 2-28
sysIO Buffer ..................................................................................................................................................... 2-28
sysIO Buffer Banks ................................................................................................................................. 2-28
Typical I/O Behavior During Power-up.................................................................................................... 2-30
Supported Standards .............................................................................................................................. 2-30
Hot Socketing.......................................................................................................................................... 2-31
Configuration and Testing ................................................................................................................................ 2-31
LatticeECP/EC Family Handbook
Table of Contents
相关PDF资料 |
PDF描述 |
|---|---|
| LFXTAL015822 | QUARTZ CRYSTAL RESONATOR, 0.032768 MHz |
| LFXTAL033073BULK | QUARTZ CRYSTAL RESONATOR, 22.1184 MHz |
| LGK2308-0301F | 2.5 MM AUDIO CONNECTOR, JACK |
| LGP1331 | 6.3V, DC POWER PLUG OR JACK |
| LGP2231 | 3.15V, DC POWER PLUG OR JACK |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LFEC10E-5FN256I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN484C | 功能描述:FPGA - 现场可编程门阵列 10.2K LUTs Pb-Free RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| LFEC10E-5FN484I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN672C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN672I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
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