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参数资料
| 型号： | LFEC10E-5FN256C |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 中文描述： | FPGA, 1280 CLBS, 10200 GATES, 420 MHz, PBGA256 |
| 封装： | 17 X 17 MM, LEAD FREE, FPBGA-256 |
| 文件页数： | 262/478页 |
| 文件大小： | 12564K |
| 代理商： | LFEC10E-5FN256C |
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www.latticesemi.com
12-1
tn1053_02.4
September 2008
Technical Note TN1053
2008 Lattice Semiconductor Corp. All Lattice trademarks, registered trademarks, patents, and disclaimers are as listed at www.latticesemi.com/legal. All other brand
or product names are trademarks or registered trademarks of their respective holders. The specifications and information herein are subject to change without notice.
Introduction
The memory in LatticeECP and LatticeEC FPGAs is built using volatile SRAM. When the power is removed,
the SRAM cells lose their contents. A supporting non-volatile memory is required to configure the device on power-
up and at any time the device needs to be updated. The LatticeECP/EC devices support a sysCONFIG interface
that provides multiple configuration modes as well as the dedicated ispJTAG port and boundary scan. The differ-
ent programming modes are listed below.
SPI
SPIX
Master Serial
Slave Serial
Master Parallel
Slave Parallel
ispJTAG (1149.1 Interface)
This technical note covers all the configuration options available for LatticeECP/EC devices.
Configuration Pins
The LatticeECP/EC devices support two types of sysCONFIG pins, dedicated and dual-purpose. The dedicated
pins are used exclusively for configuration; the dual-purpose pins are available as extra I/O pins. If a dual-purpose
pin is to be used both for configuration and as a general purpose I/O the user must adhere to the following:
The general purpose I/O (GPIO) must maintain the same direction as it has during configuration, in other words,
if the pin is an input during configuration it must remain an input as a GPIO, if an output during configuration it
must remain an output as a GPIO, if a bi-directional it must remain a bi-directional as a GPIO.
The I/O type must remain the same, in other words if the pin is a 3.3V CMOS pin (LVCMOS33) during configura-
tion it must remain a 3.3V CMOS pin as a GPIO.
The Persistent option must be set to OFF. The Persistent option can be accessed by using the Preference Editor
in ispLEVER.
The user is responsible for insuring that no internal or external logic will interfere with device configuration.
Also note, if a parallel configuration mode is not being used then one or both of the parallel port chip selects (CSN,
CS1N) must be high or tri-state during configuration.
Programmable options control the dual-purpose configuration pins. These options are controlled via a preference
in Lattice ispLEVER software, or as an HDL source file attribute. The LatticeECP/EC devices also support the
ispJTAG port for configuration, including transparent read back and JTAG testing. The following sections describe
the functionality of the sysCONFIG and JTAG pins. Table 12-1 is provided for reference.
LatticeECP/EC sysCONFIG
Usage Guide
相关PDF资料 |
PDF描述 |
|---|---|
| LFXTAL015822 | QUARTZ CRYSTAL RESONATOR, 0.032768 MHz |
| LFXTAL033073BULK | QUARTZ CRYSTAL RESONATOR, 22.1184 MHz |
| LGK2308-0301F | 2.5 MM AUDIO CONNECTOR, JACK |
| LGP1331 | 6.3V, DC POWER PLUG OR JACK |
| LGP2231 | 3.15V, DC POWER PLUG OR JACK |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LFEC10E-5FN256I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN484C | 功能描述:FPGA - 现场可编程门阵列 10.2K LUTs Pb-Free RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| LFEC10E-5FN484I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN672C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN672I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
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