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参数资料
| 型号： | LFEC10E-5FN256C |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 中文描述： | FPGA, 1280 CLBS, 10200 GATES, 420 MHz, PBGA256 |
| 封装： | 17 X 17 MM, LEAD FREE, FPBGA-256 |
| 文件页数： | 400/478页 |
| 文件大小： | 12564K |
| 代理商： | LFEC10E-5FN256C |
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21-3
SPI Serial Flash Programming Using ispJTAG
Lattice Semiconductor
on LatticeECP/EC FPGAs
SPI Serial Flash Interface
The standard pin-out for 8-pin SPI Serial Flash memories is shown below (top view):
Figure 21-1. 8-Pin SPI Flash Memory, Standard Pinout
Note: VCCIO for the bank that drives the signals to the SPI Serial Flash must match the SPI Serial Flash VCC (today
that voltage is 3.3V but this will change over time as Flash chip geometries decrease). For all LatticeECP/EC pack-
ages these signals are located in bank 3.
The SPI interface is a 4-wire serial interface comprised of the following signals:
1.
CS – Chip Select, Input: Enables and disables device operation. When high the device is at standby
power levels and the output is tri-stated. When low the device powers up and instructions can be written to
and data read from the device.
2.
CLK – Serial Clock, Input: Provides timing for the interface. The Serial Data Input (DI) is latched on the
rising edge of CLK. Serial Data Output (DO) changes after the falling edge of CLK.
3.
DI – Serial Data In, Input: When the device is enabled (CS is low) this pin allows instructions, addresses,
and data to be serially written to the device. Data is latched on the rising edge of the CLK.
4.
DO – Serial Data Out, Output: When the device is enabled (CS is low) this pin allows data and status to
be serially read from the device. Data is shifted out on the falling edge of the CLK.
The SPI interface also supports the following two functions:
1.
HOLD – Input: Allows device to be paused without de-selecting it. When HOLD is low DO will be tri-stated
while DI and CLK are ignored. This function is useful when multiple devices are sharing the same SPI sig-
nals.
2.
WP – Write Protection, Input: Used to prevent inadvertent writing of the Status Register Block Protect
bits.
Note: The LatticeECP/EC SPI interface supports the basic 4-wire interface, but the user is free to implement these
additional functions if desired.
ispJTAG Interface
The ispJTAG interface supports both IEEE 1149.1 Boundary Scan and IEEE 1532 In-System Configuration. Stan-
dard pinouts for 1x10, 1x8, and 2x5 download headers are shown in Table 21-4. The 1x10 header is preferred but
ultimately the header chosen will depend on the available download cable. All new download cables have uncom-
mitted “flywire” connections, so they can be attached to any of the header styles. Direction, in Table 21-4, refers to
the cable, for example “output” indicates an output from the cable to the FPGA.
1
2
3
4
CS
DO
WP
GND
VCC
HOLD
CLK
DI
8
7
6
5
相关PDF资料 |
PDF描述 |
|---|---|
| LFXTAL015822 | QUARTZ CRYSTAL RESONATOR, 0.032768 MHz |
| LFXTAL033073BULK | QUARTZ CRYSTAL RESONATOR, 22.1184 MHz |
| LGK2308-0301F | 2.5 MM AUDIO CONNECTOR, JACK |
| LGP1331 | 6.3V, DC POWER PLUG OR JACK |
| LGP2231 | 3.15V, DC POWER PLUG OR JACK |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LFEC10E-5FN256I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN484C | 功能描述:FPGA - 现场可编程门阵列 10.2K LUTs Pb-Free RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| LFEC10E-5FN484I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN672C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
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