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参数资料
型号： LFEC10E-5FN256C
厂商： LATTICE SEMICONDUCTOR CORP
元件分类： FPGA
中文描述： FPGA, 1280 CLBS, 10200 GATES, 420 MHz, PBGA256
封装： 17 X 17 MM, LEAD FREE, FPBGA-256
文件页数： 263/478页
文件大小： 12564K
代理商： LFEC10E-5FN256C
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12-2
Lattice Semiconductor
LatticeECP/EC sysCONFIG Usage Guide
Table 12-1. Configuration Pins for LatticeECP/EC Devices
Dedicated Control Pins
The following is a description of the LatticeECP/EC’s dedicated sysCONFIG pins used for controlling configuration.
CFG[0:2]
The Configuration Mode pins CFG[0:2] are input pins. They are used to select the configuration mode. Depending
on the configuration mode selected, different groups of dual-purpose configuration pins will be activated on Power-
On-Reset or when the PROGRAMN pin is driven low.
PROGRAMN
The PROGRAMN pin is an input to the device used to initiate a Programming sequence. A high to low signal
applied to the pin sets the device into configuration mode. The PROGRAMN pin can be used to trigger program-
ming other than at powering up. If the device is using JTAG, the device will ignore the PROGRAMN pin until the
device is released from the JTAG mode.
INITN
The INITN pin is a bidirectional open drain control pin. It is capable of driving a low pulse out as well as detecting a
low pulse driven in. When the PROGRAMN Pin is driven low, or after the internal Power-On-Reset signal is
released during Power-up, the INITN pin will be driven low to reset the configuration circuitry and any External
PROM. The configuration memory will be cleared and the INITN pin will remain low as long as the PROGRAMN pin
is low. To delay configuration the INITN pin can be held low externally. The device will not enter configuration mode
as long as the INITN pin is held low. Toggling the PROGRAMN pin in Serial and Parallel programming modes will
initiate the configuration sequence and reset the INITN pin. For SPI mode, power cycling the device will initiate the
reconfiguration sequence.
During configuration, the INITN pin becomes an error detection pin. It will be driven low whenever a configuration
error occurs.
DONE
The DONE pin is a bidirectional control pin. It can be configured as an open drain or active drive control pin. The
DONE pin will be driven low when the device is in configuration mode and the internal DONE bit is not pro-
grammed. When the INITN and PROGRAMN pins are high and the DONE bit is programmed, the DONE pin will be
Pin(s)
Description
Default Pin Function
Mode Used
CFG[0:2]
Input
Dedicated
All
PROGRAMN
Input
Dedicated
All
INITN
Bi-directional open drain
Dedicated
All
DONE1
Bi-directional
Dedicated
All
CCLK
Output or input
Dedicated
MASTER = output, SLAVE = input
DI/CSSPIN
Input/output with weak pull-up
—
SERIAL/SPI
DOUT/CSON
Output
—
SERIAL/PARALLEL
CSN
Input
—
PARALLEL
CS1N
Input
—
PARALLEL
WRITEN
Input
—
PARALLEL
BUSY/SISPI
Output
—
PARALLEL/SPI
D[0:7]/SPID[7:0]
Input or output
—
PARALLEL/SPI
TDI
Input with pull-up
Dedicated
JTAG
TDO
Output
Dedicated
JTAG
TCK
Input with hysteresis, no pull-up
Dedicated
JTAG
TMS
Input with pull-up
Dedicated
JTAG
1. Defaults to open drain with an internal pull-up.
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PDF描述
LFXTAL015822 QUARTZ CRYSTAL RESONATOR, 0.032768 MHz
LFXTAL033073BULK QUARTZ CRYSTAL RESONATOR, 22.1184 MHz
LGK2308-0301F 2.5 MM AUDIO CONNECTOR, JACK
LGP1331 6.3V, DC POWER PLUG OR JACK
LGP2231 3.15V, DC POWER PLUG OR JACK
相关代理商/技术参数
参数描述
LFEC10E-5FN256I 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet
LFEC10E-5FN484C 功能描述:FPGA - 现场可编程门阵列 10.2K LUTs Pb-Free RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256
LFEC10E-5FN484I 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet
LFEC10E-5FN672C 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet
LFEC10E-5FN672I 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet
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