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参数资料
| 型号： | LFEC10E-5FN256C |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 中文描述： | FPGA, 1280 CLBS, 10200 GATES, 420 MHz, PBGA256 |
| 封装： | 17 X 17 MM, LEAD FREE, FPBGA-256 |
| 文件页数： | 358/478页 |
| 文件大小： | 12564K |
| 代理商： | LFEC10E-5FN256C |
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Lattice Semiconductor FPGA
Lattice Semiconductor
Successful Place and Route
17-14
Figure 17-12. Clock Boosting Window
Other important considerations on the practicality of using clock boosting:
Some circuits show big improvement, others have no gain. Clock boosting results are very design-depen-
dent.
Clock boosting uses minimum delay values which have not yet been validated at the system level.
Automatic clock boosting identifies skew and hold time issues. However, after clock boosting is performed,
designers are strongly recommended to run Trace twice, once with regular, maximum delay analysis, and
again with minimum delays. The designer should then read over both resultant .twr timing reports to make
sure there are no timing errors. The minimum delay analysis is done by checking the “Check Hold Times”
checkbox in the Trace Options GUI window.
Guided Map and PAR
To decrease PAR runtimes after minor changes to a logical design, guided mapping uses a previously generated
.ncd file to “guide” the mapping of the new logical design. Guided mapping can be performed from the Guide File-
name property in the Project Navigator Map Design process, or specified using the command line
-g option with
the file name of the guide file. In general, guided MAP should only be used in conjunction with guided PAR.
To Perform Guided Mapping in the Project Navigator
1. In the Project Navigator Sources window, select the
target device.
2. In the Processes window, right-click the
Map Design process, and then select Properties to open the
Properties dialog box.
3. Select the
Guide Filename property from the property list and type the name of the guide file name in the
edit region (<file_name>.ncd).
4. Click
Close to close the dialog box.
The Map operation will use the guide file to generate the new design file.
To Perform Guided PAR in the Project Navigator
1. In the Project Navigator Sources window, select the
target device.
2. In the Processes window, right-click the
Place & Route Design process and select Properties to open the
dialog box.
3. Under Advanced Options, select the
Guide Filename property and type the name of the file in the text
field.
相关PDF资料 |
PDF描述 |
|---|---|
| LFXTAL015822 | QUARTZ CRYSTAL RESONATOR, 0.032768 MHz |
| LFXTAL033073BULK | QUARTZ CRYSTAL RESONATOR, 22.1184 MHz |
| LGK2308-0301F | 2.5 MM AUDIO CONNECTOR, JACK |
| LGP1331 | 6.3V, DC POWER PLUG OR JACK |
| LGP2231 | 3.15V, DC POWER PLUG OR JACK |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LFEC10E-5FN256I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN484C | 功能描述:FPGA - 现场可编程门阵列 10.2K LUTs Pb-Free RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| LFEC10E-5FN484I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN672C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC10E-5FN672I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
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