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参数资料
| 型号： | M68HC12B |
| 厂商： | 飞思卡尔半导体(中国)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件页数： | 31/334页 |
| 文件大小： | 1671K |
| 代理商： | M68HC12B |
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Pinout and Signal Descriptions
M68HC12B Family Data Sheet, Rev. 9.1
Freescale Semiconductor
31
Table 1-3. Signal Description Summary
Pin
Name
PW3–PW0
ADDR7–ADDR0
DATA7–DATA0
ADDR15–ADDR8
DATA15–DATA8
Pin
Number
3–6
Description
Pulse-width modulator channel outputs
25–18
External bus pins share function with general-purpose I/O ports A and B. In single-chip
modes, the pins can be used for I/O. In expanded modes, the pins are used for the
external buses.
46–39
IOC7–IOC0
16–12, 9–7
Pins used for input capture and output compare in the timer and pulse accumulator
subsystem
Pulse accumulator input
Analog inputs for the analog-to-digital conversion module
Data bus control and, in expanded mode, enables the drive control of external buses
during external reads
State of mode select pins during reset determines the initial operating mode of the
MCU. After reset, MODB and MODA can be configured as instruction queue tracking
signals IPIPE1 and IPIPE0 or as general-purpose I/O pins.
E-clock is the output connection for the external bus clock. ECLK is used as a timing
reference and for address demultiplexing.
An active low bidirectional control signal, RESET acts as an input to initialize the MCU
to a known startup state and an output when COP or clock monitor causes a reset.
PAI
16
AN7–AN0
58–51
DBE
26
MODB, MODA
27, 28
IPIPE1, IPIPE0
27, 28
ECLK
29
RESET
32
EXTAL
XTAL
33
34
Crystal driver and external clock input pins. On reset all the device clocks are derived
from the EXTAL input frequency. XTAL is the crystal output.
LSTRB
35
Low byte strobe (0 = low byte valid), in all modes this pin can be used as I/O. The low
strobe function is the exclusive-NOR of A0 and the internal SZ8 signal. The SZ8
internal signal indicates the size 16/8 access.
Pin used in instruction tagging
Indicates direction of data on expansion bus; shares function with general-purpose I/O;
read/write in expanded modes
Maskable interrupt request input provides a means of applying asynchronous interrupt
requests to the MCU. Either falling edge-sensitive triggering or level-sensitive
triggering is program selectable (INTCR register).
Provides a means of requesting asynchronous non-maskable interrupt
requests after
reset initialization
Single-wire background interface pin is dedicated to the background debug function.
During reset, this pin determines special or normal operating mode.
Pin used in instruction tagging
TAGLO
35
R/W
36
IRQ
37
XIRQ
38
BKGD
17
TAGHI
17
DLCRx/RxCAN
(1)
DLCTx/TxCAN
(1)
CS/SS
SCK
SDO/MOSI
SDI/MISO
TxD0
RxD0
1. The RxCAN and TxCAN designations are for the MC68HC(9)12BC32 only.
76
BDLC receive pin
75
BDLC transmit pin
68
67
66
65
62
61
Slave-select output for SPI master mode; input for slave mode or master mode
Serial clock for SPI system
Master out/slave in pin for serial peripheral interface
Master in/slave out pin for serial peripheral interface
SCI transmit pin
SCI receive pin
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