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参数资料
| 型号： | MC13892JVLR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 37/158页 |
| 文件大小： | 0K |
| 描述： | IC PMU I.MX51/37/35/27 186MAPBGA |
| 标准包装： | 1,000 |
| 应用： | 电池管理，显示器（LED 驱动器），手持/移动设备，电源 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 186-LFBGA |
| 供应商设备封装： | 186-PBGA（12x12） |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DESCRIPTION
FUNCTIONAL PIN DESCRIPTION
PWRON1, 2 AND 3
A turn on event can be accomplished by connecting an open drain NMOS driver to the PWRONx pin of the MC13892, so that
it is in effect a parallel path for the power key.
In addition to the turn on event, the MC13892A/B/C/D versions include a global reset feature on the PWRON3 pin.
On the A/B/C/D versions, the GLBRSTENB defaults to 0. In the MC13892A/C versions global reset is active low. Since
GLBRSTENB defaults to 0, the global reset feature is enabled by default. In the MC13892B/D versions global reset is active high.
Since GLBRSTENB defaults to 0, the global reset feature is disabled by default. The global reset function can be enabled or
disabled by changing the SPI bit GLBRSTENB at any time, as shown in table below:
Device
MC13892
MC13892A
Global Reset
Function
NO
YES
GLBRSTENB
Configuration
N/A
Active low
GLBRSTENB
N/A
0 = Enabled (default)
1 = Disabled
MC13892B
YES
Active HI
0 = Disabled (default)
1 = Enabled
MC13892C
YES
Active low
0 = Enabled (default)
1 = Disabled
MC13892D
YES
Active HI
0 = Disabled (default)
1 = Enabled
The global reset feature powers down the part, disables the charger, resets the SPI registers to their default value and then
powers back on. To generate a global reset, the PWRON3 pin needs to be pulled low for greater than 12 seconds and then pulled
back high. If the PWRON3 pin is held low for less than 12 seconds, the pin will act as a normal PWRON pin.
PUMS1 AND PUMS2
Power up mode supply setting. Default start-up of the device is selectable by hardwiring the Power Up Mode Select pins. The
Power Up Mode Select pins (PUMS1 and PUMS2) are used to configure the start-up characteristics of the regulators. Supply
enabling and output level options are selected by hardworking the PUMS pins for the desired configuration.
MODE
USB LBP mode, normal mode, test mode selection & anti-fuse bias. During evaluation and testing, the IC can be configured
for normal operation or test mode via the MODE pin as summarized in the following table.
MODE PIN STATE
Ground
VCOREDIG
VCORE
MODE
Normal Operation
USB Low-power Boot Allowed
Test Mode
GNDCTRL
Ground for control logic.
SPIVCC
Supply for SPI bus and audio bus
CS
CS held low at Cold Start configures the interface for SPI mode. Once activated, CS functions as the SPI Chip Select. CS tied
to VCORE at Cold Start configures the interface for I 2 C mode; the pin is not used in I 2 C mode other than for configuration.
Because the SPI interface pins can be reconfigured for reuse as an I 2 C interface, a configuration protocol mandates that the
CS pin is held low during a turn on event for the IC (a weak pull-down is integrated on the CS pin).
MC13892
Analog Integrated Circuit Device Data
Freescale Semiconductor
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PDF描述 |
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| MC13892JVKR2 | IC PMU I.MX51/37/35/27 139MAPBGA |
相关代理商/技术参数 |
参数描述 |
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