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参数资料
| 型号： | MC68MH360VR33LR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 115/158页 |
| 文件大小： | 0K |
| 描述： | IC MPU QUICC 33MHZ 357-PBGA |
| 标准包装： | 180 |
| 系列： | M683xx |
| 处理器类型： | M683xx 32-位 |
| 速度： | 33MHz |
| 电压： | 5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 357-BBGA |
| 供应商设备封装： | 357-PBGA（25x25） |
| 包装： | 带卷 (TR) |
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QMC Supplement
CONTENTS
Paragraph
Number
Title
Page
Number
2.1.9
Data Buffer .......................................................................................................2-5
2.2
Global Multichannel Parameters ..........................................................................2-5
2.3
Multiple SCC Assignment Tables ......................................................................2-10
2.4
Channel-Specific Parameters..............................................................................2-14
2.4.1
Channel-Specific HDLC Parameters..............................................................2-14
2.4.1.1
CHAMR—Channel Mode Register (HDLC).............................................2-15
2.4.1.2
TSTATE—Tx Internal State (HDLC)........................................................2-17
2.4.1.3
INTMSK—Interrupt Mask (HDLC) ..........................................................2-18
2.4.1.4
RSTATE—Rx Internal State (HDLC) .......................................................2-19
2.4.2
Channel-Specific Transparent Parameters .....................................................2-20
2.4.2.1
CHAMR—Channel Mode Register (Transparent Mode) ..........................2-21
2.4.2.2
TSTATE—Tx Internal State (Transparent Mode) .....................................2-23
2.4.2.3
INTMSK—Interrupt Mask (Transparent Mode)........................................2-24
2.4.2.4
TRNSYNC—Transparent Synchronization ...............................................2-24
2.4.2.5
RSTATE—Rx Internal State (Transparent Mode).....................................2-28
Chapter 3
QMC Commands
3.1
Transmit Commands.............................................................................................3-1
3.2
Receive Commands ..............................................................................................3-2
Chapter 4
QMC Exceptions
4.1
Global Error Events ..............................................................................................4-2
4.1.1
Global Underrun (GUN)...................................................................................4-3
4.1.2
Global Overrun (GOV) in the FIFO .................................................................4-3
4.1.3
Restart from a Global Error ..............................................................................4-3
4.2
SCC Event Register (SCCE) ................................................................................4-3
4.3
Interrupt Table Entry ............................................................................................4-5
4.4
Channel Interrupt Processing Flow ......................................................................4-7
Chapter 5
Buffer Descriptors
5.1
Receive Buffer Descriptor ....................................................................................5-1
5.2
Transmit Buffer Descriptor ..................................................................................5-5
5.3
Placement of Buffer Descriptors ..........................................................................5-7
5.3.1
MC68MH360 Internal Memory Structure........................................................5-7
5.3.2
Parameter RAM Usage for QMC over Several SCCs......................................5-9
5.3.3
MPC860MH Internal Memory Structure .......................................................5-14
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
|---|---|
| MC68MH360VR25LR2 | IC MPU QUICC 25MHZ 357-PBGA |
| MC68MH360VR25L | IC MPU QUICC 25MHZ 357-PBGA |
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参数描述 |
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