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参数资料
| 型号： | MC68MH360VR33LR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 152/158页 |
| 文件大小： | 0K |
| 描述： | IC MPU QUICC 33MHZ 357-PBGA |
| 标准包装： | 180 |
| 系列： | M683xx |
| 处理器类型： | M683xx 32-位 |
| 速度： | 33MHz |
| 电压： | 5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 357-BBGA |
| 供应商设备封装： | 357-PBGA（25x25） |
| 包装： | 带卷 (TR) |
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Chapter 6. QMC Initialization
Step 5: Congure port C for TDMa and/or TDMb signals L1ST1, 2, 3, and/or 4;
L1TSYNCx and/or L1RSYNCx. For more information on port C, see page 7-365 of the
MC68360 User’s Manual and page 16-465 of the MPC860 User’s Manual.
The following setting enables L1RSYNCx, L1TSYNCx, and all L1STx strobes. Note that
if common clocking is used, selected by the CRTx bit in the SI MODE register, only
L1RSYNCx is required. Note that the L1STx functions are repeated on Port B and should
only be congured on one port.
PCPAR = 0x0F0F;
/* init port C pin assignment register */
PCDIR = 0x000F;
/* init port C data direction register */
Step 6: Write the values to the SI RAM locations that will route the time slots required. For
more information on SI RAM programming, see page 7-72 of the MC68360 User’s Manual
and page 16-106 of the MPC860 User’s Manual.
The following example congures every byte to be transferred to SCC1; note that the nal
entry in both the Tx and Rx tables has the LST bit set. Also, this example for TDMa
assumes that SIGMR[RDM] is set to 0b10 (32 entries for Rx and Tx). If n is the last entry,
the following applies:
SIRAM[0] = 0x0042;
/* init 1st receive element */
SIRAM[1] = 0x0042;
/* init 2nd receive element */
SIRAM[n-1] = 0x0043;
/* init nth receive element */
SIRAM[32] = 0x0042;
/* init 1st xmit element */
SIRAM[33] = 0x0042;
/* init 2nd xmit element */
SIRAM[34] = 0x0042;
/* init 3rd xmit element */
SIRAM[32+n] = 0x0043;
/* init nth xmit element */
NOTE
On the MH360, the SI RAM is mapped in a continuous 256-
byte block from REGB + 700->7FF. On the 860MH, it is
mapped to a 512-byte block from C00->DFF. Also on the
860MH, the SI RAM has 16-bit entries aligned to 32-bit
boundaries; therefore, only half of the actual address space is
valid (there are 256 valid bytes).
F
re
e
sc
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c
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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