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参数资料
| 型号： | MCIMX534AVV8C |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 800 MHz, RISC PROCESSOR, PBGA529 |
| 封装： | 19 X 19 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, TEPBGA-529 |
| 文件页数： | 174/178页 |
| 文件大小： | 4711K |
| 代理商： | MCIMX534AVV8C |
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Electrical Characteristics
i.MX53xA Automotive and Infotainment Applications Processors, Rev. 3
Freescale Semiconductor
95
4.7.8.7
Interface to a TV Encoder (TVDAC)
The interface has an 8-bit data bus, transferring a single 8-bit value (Y/U/V) in each cycle. The timing of
the interface is described in Figure 51.
NOTE
The frequency of the clock DISP_CLK is 27 MHz (within 10%)
The HSYNC, VSYNC signals are active low.
The DRDY signal is shown as active high.
The transition to the next row is marked by the negative edge of the
HSYNC signal. It remains low for a single clock cycle.
The transition to the next field/frame is marked by the negative edge of
the VSYNC signal. It remains low for at least one clock cycles.
—
At a transition to an odd field (of the next frame), the negative edges
of VSYNC and HSYNC coincide.
—
At a transition is to an even field (of the same frame), they do not
coincide.
The active intervals—during which data is transferred—are marked by
the HSYNC signal being high.
2 Display interface clock down time
3 Display interface clock up time where CEIL(X) rounds the elements of X to the nearest integers towards infinity.
Tdicd
1
2
---T
diclk
ceil
×
2
DISP_CLK_DOWN
×
DI_CLK_PERIOD
-----------------------------------------------------------
=
Tdicu
1
2
---T
diclk
ceil
×
2
DISP_CLK_UP
×
DI_CLK_PERIOD
------------------------------------------------
=
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