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参数资料
| 型号： | ML60852A |
| 厂商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 31/82页 |
| 文件大小： | 370K |
| 代理商： | ML60852A |
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FEDL60852A-03
1Semiconductor
ML60852A
36/81
EP5 FIFO (EP5FIFO)
Address
0 x 7D
Type
Byte data
Access type
Write only
or
Read only
D7
D6
D5
D4
D3
D2
D1
D0
After a hardware reset
x
xxxx
xx
After a bus reset
x
xxxx
xx
Definition
EP5 Transmit data or EP5 receive data
In the ML60852A, by making a setting of the system control register, it is possible to select either the 5EP mode
with the number of EPs being 5 or the 6EP mode with the number of EPs being 6. In the 5EP mode, only EP0 to
EP4 are present and EP5 will not be present. In the EP6 mode, all end points EP0 to EP5 will be valid.
It is possible to specify the direction of transfer of EP5 by setting the EP5 configuration register EP5CONF. The
FIFO address of EP5 is the same in both the transmit direction and the receive direction.
When EP5CONF (D7) = 0, EP5 is in the receive direction and EP5FIFO is in the read-only state.
When EP5CONF (D7) = 1, EP5 is in the transmit direction and EP5FIFO is in the write-only state.
When set for transmission, all bytes of EP5FIFO can be cleared by clearing EP5FIFO (writing a “1” into EP5CONT
(D2)).
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