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参数资料
| 型号： | ML60852A |
| 厂商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 71/82页 |
| 文件大小： | 370K |
| 代理商： | ML60852A |
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FEDL60852A-03
1Semiconductor
ML60852A
72/81
DMA Transfer Timing (1)
ML60852A to Memory (Single Transfer, Single Address Mode)
Parameter
Symbol
Condition
Min.
Max.
Unit
Note
DREQ Disable Time
t
1
Load 20 pF
—
20
ns
DREQ Enable Time
t
2
—63
ns
(4)
DACK Hold Time
t
3
0—
ns
Read Data Delay Time
t
4
Load 20 pF
—
46
ns
(1)
Data Hold Time
t
5
0—
ns
8-bit DMA
63
—
ns
(2)
Recovery Time
t
6
16-bit DMA
105
—
ns
(3)
Notes: (1) When in Single Address mode,
CS and A6: A0 are ignored.
t
1 and t4 are defined depending on DACK or RD which becomes active last.
(2) 3-clock time of oscillation clock (clock period: 21 ns).
(3) 5-clock time of oscillation clock (clock period: 21 ns).
(4) It is possible to increase t
2 by setting the DMA interval register (DMAINTVL).
DACK
DATA OUT
,4-3
DOUT
4,
t4
t3
t5
t6
t2
t1
DREQ
RD
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