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参数资料
| 型号： | ML60852A |
| 厂商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 40/82页 |
| 文件大小： | 370K |
| 代理商： | ML60852A |
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FEDL60852A-03
1Semiconductor
ML60852A
44/81
Interrupt Status Register 1 (INTSTAT1)
Address
0 x 21
Type
Bit map
Access type
Read only
D7
D6
D5
D4
D3
D2
D1
D0
After a hardware reset
0
0000
00
After a bus reset
X
x
xxxx
x
0
Definition
Note:
When isochronous transfer has been set in the EP4 or EP5 configuration register, the EP4 or EP5
packet ready interrupt status will always be fixed at “0”.
Setup ready
interrupt status
(stup_ry)
EP1 packet ready
interrupt status
(ep1_pry)
EP3 packet ready interrupt status
(ep3_pry)
EP4 packet ready interrupt status
(ep4_pry) (Note)
EP2 packet ready interrupt status
(ep2_pry)
EP5 packet ready interrupt status (ep5_pry) (Note)
EP0 receive packet ready interrupt status
EP0 transmit packet ready interrupt status
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