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参数资料
| 型号： | ML60852A |
| 厂商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP44 |
| 封装： | PLASTIC, QFP-44 |
| 文件页数： | 56/82页 |
| 文件大小： | 370K |
| 代理商： | ML60852A |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页当前第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页
FEDL60852A-03
1Semiconductor
ML60852A
5/81
PIN DESCRIPTION
Pin name
Pin count
I/O
Description
D+, D-
2
I/O
USB data
XIN, XOUT
2
—
Pins for external crystal
AD7:AD0
8
I/O
Data bus (LSB)/address inputs
A6:A0
7
I
Address inputs
D15:D8
8
I/O
Data bus (MSB)
CS
1
I
Chip select signal input pin. Active “L”
RD
1
I
Read signal input pin. Active “L”
WR
1
I
Write signal input pin. Active “L”
INTR
1
O
Interrupt request signal output pin
DREQ0
1
O
DMA0 request output pin
DREQ1
1
O
DMA1 request output pin
DACK0
1
I
DMA0 reception signal input pin
DACK1
1
I
DMA1 reception signal input pin
ALE/PUCTL
1
I,O
Address latch enable signal input pin/pull-up control pin
ADSEL
1
I
Address input format select input pin
RESET
1
I
Reset signal input pin
TEST1, TEST2
2
I
Test pin. (Normally at “L”)
V
CC
2
3.3 V power supply pin
GND
2
GND
44
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