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参数资料
| 型号： | RK80532RC056128 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2400 MHz, MICROPROCESSOR, CPGA478 |
| 封装： | FLIP CHIP, PGA2-478 |
| 文件页数： | 29/99页 |
| 文件大小： | 4142K |
| 代理商： | RK80532RC056128 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页当前第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页
Datasheet
35
Electrical Specifications
Figure 11. System Bus Reset and Configuration Timings
Figure 12. Source Synchronous 2X (Address) Timings
BCLK
Reset
Configuration
A[31:3], SMI#,
INIT#, BR[3:0]#
Valid
Tv = T13 (RESET# Pulse Width)
Tw = T45 (Reset Configuration Signals Setup TIme)
Tx = T46 (Reset Configuration Signals Hold TIme)
Tx
Tv
Tt
Tw
T
J
BCLK0
BCLK1
ADSTB# (@ driver)
A# (@ driver)
A# (@ receiver)
ADSTB# (@ receiver)
T1
T2
2.5 ns
5.0 ns
7.5 ns
T
H
T
H
T
J
T
N
T
K
T
M
valid
T
H = T23: Source Sync. Address Output Valid Before Address Strobe
T
J = T24: Source Sync. Address Output Valid After Address Strobe
T
K = T27: Source Sync. Input Setup to BCLK
T
M = T26: Source Sync. Input Hold Time
T
N = T25: Source Sync. Input Setup Time
T
P = T28: First Address Strobe to Second Address Strobe
T
S = T20: Source Sync. Output Valid Delay
T
R = T31: Address Strobe Output Valid Delay
T
P
T
R
T
S
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