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参数资料
| 型号： | SX1211I084TRT |
| 厂商： | Semtech |
| 文件页数： | 23/92页 |
| 文件大小： | 0K |
| 描述： | IC SNGL-CHIP TXRX 32-TQFN |
| 标准包装： | 1 |
| 频率： | 860 ~ 960MHz |
| 数据传输率 - 最大： | 200kbps |
| 调制或协议： | FSK，OOK |
| 应用： | AMR，ISM，安防门禁 |
| 功率 - 输出： | 12.5dBm |
| 灵敏度： | -113dBm |
| 电源电压： | 2.1 V ~ 3.6 V |
| 电流 - 接收： | 3mA |
| 电流 - 传输： | 25mA |
| 数据接口： | PCB，表面贴装 |
| 天线连接器： | PCB，表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-TQFN |
| 包装： | 标准包装 |
| 产品目录页面： | 584 (CN2011-ZH PDF) |
| 配用： | 1210-1060-2-ND - 915MHZ ASPICS SX1211 CHIP SET 1210-1059-2-ND - 868MHZ ASPICS SX1211 CHIP SET 1210-1060-6-ND - 915MHZ ASPICS SX1211 CHIP SET 1210-1059-6-ND - 868MHZ ASPICS SX1211 CHIP SET 1210-1060-1-ND - 915MHZ ASPICS SX1211 CHIP SET 1210-1059-1-ND - 868MHZ ASPICS SX1211 CHIP SET |
| 其它名称： | SX1211I084DKR |
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SX1211
WIRELESS & SENSING
3.4. Receiver Description
The SX1211 is set to receive mode when MCParam_Chip_mode = 011.
First down-
conversion
Second down-
conversion
RSSI
OOK
demod
Bit
synchronizer
Control logic
-Pattern recognition
-FIFO handler
-SPI interface
-Packet handler
LNA
RF
LO1 Rx
IF1
LO2 Rx
FSK
demod
Baseband, IF2 in OOK
Figure 14: Receiver Architecture
3.4.1. Architecture
The SX1211 receiver employs a super-heterodyne architecture. Here, the first IF is 1/9 th of the RF frequency
(approximately 100MHz). The second down-conversion down-converts the I and Q signals to base band in the
case of the FSK receiver (Zero IF) and to a low-IF (IF2) for the OOK receiver.
Second
down-conversion
LO2
Rx
First
down-conversion
0
IF2=0
in FSK
IF1
≈ 100MHz
Image
frequency
LO1 Rx
Channel
Frequencyl
mode
Figure 15: FSK Receiver Setting
First
Second
down-conversion
down-conversion
IF2<0
in FSK
0
IF1
≈ 100MHz
LO2 Rx
Image
frequency
LO1 Rx
Channel
Frequency
mode
equal to fo
Figure 16: OOK Receiver Setting
After the second down-conversion stage, the received signal is channel-select filtered and amplified to a level
adequate for demodulation. Both FSK and OOK demodulation are available. Finally, an optional Bit Synchronizer
(BitSync) is provided, to be supply a synchronous clock and data stream to a companion uC in Continuous mode,
Rev 8 – February 2013
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www.semtech.com
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PDF描述 |
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参数描述 |
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