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参数资料
| 型号： | SX1211I084TRT |
| 厂商： | Semtech |
| 文件页数： | 36/92页 |
| 文件大小： | 0K |
| 描述： | IC SNGL-CHIP TXRX 32-TQFN |
| 标准包装： | 1 |
| 频率： | 860 ~ 960MHz |
| 数据传输率 - 最大： | 200kbps |
| 调制或协议： | FSK，OOK |
| 应用： | AMR，ISM，安防门禁 |
| 功率 - 输出： | 12.5dBm |
| 灵敏度： | -113dBm |
| 电源电压： | 2.1 V ~ 3.6 V |
| 电流 - 接收： | 3mA |
| 电流 - 传输： | 25mA |
| 数据接口： | PCB，表面贴装 |
| 天线连接器： | PCB，表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-TQFN |
| 包装： | 标准包装 |
| 产品目录页面： | 584 (CN2011-ZH PDF) |
| 配用： | 1210-1060-2-ND - 915MHZ ASPICS SX1211 CHIP SET 1210-1059-2-ND - 868MHZ ASPICS SX1211 CHIP SET 1210-1060-6-ND - 915MHZ ASPICS SX1211 CHIP SET 1210-1059-6-ND - 868MHZ ASPICS SX1211 CHIP SET 1210-1060-1-ND - 915MHZ ASPICS SX1211 CHIP SET 1210-1059-1-ND - 868MHZ ASPICS SX1211 CHIP SET |
| 其它名称： | SX1211I084DKR |
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SX1211
WIRELESS & SENSING
Table 15: Config vs. Data SPI Interface Selection
NSS_DATA
0
0
1
1
NSS_CONFIG
0
1
0
1
SPI Interface
Config
Data
Config
None
The following paragraphs describe how to use each of these interfaces.
5.2.1.2. SPI Config
Write Register
To write a value into a configuration register the timing diagram below should be carefully followed by the uC.
The register’s new value is effective from the rising edge of NSS_CONFIG.
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
NSS_CONFIG (In)
SCK (In)
New value at
address A1
MOSI (In)
start
rw
A(4) A(3) A(2) A(1) A(0) stop D(7) D(6) D(5) D(4) D(3) D(2) D(1) D(0)
Current value at
Address = A1
address A1*
MISO (Out) HZ
x
x
x
x
x
x
x
x
D(7) D(6) D(5) D(4) D(3) D(2) D(1)
D(0)
HZ
(input)
(input)
* when writing the new value at address A1, the current content of A1 can be read by the uC.
(In)/(Out) refers to SX1211 side
Figure 27: Write Register Sequence
Note that when writing more than one register successively, it is not compulsory to toggle NSS_CONFIG back high
between two write sequences. The bytes are alternatively considered as address and value. In this instance, all
new values will become effective on rising edge of NSS_CONFIG.
Read Register
To read the value of a configuration register the timing diagram below should be carefully followed by the uC.
Rev 8 – February 2013
Page 36 of 92
www.semtech.com
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