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参数资料
| 型号： | TRC103 |
| 厂商： | RFM |
| 文件页数： | 32/65页 |
| 文件大小： | 0K |
| 描述： | RFIC TRANSCEIVER MULTI-CHANNEL F |
| 标准包装： | 1 |
| 系列： | TRC |
| 频率： | 863MHz ~ 960MHz |
| 数据传输率 - 最大： | 100kbps |
| 调制或协议： | FSK，OOK |
| 应用： | 通用 |
| 功率 - 输出： | 11dBm |
| 灵敏度： | -112dBm |
| 电源电压： | 2.1 V ~ 3.6 V |
| 电流 - 接收： | 4mA |
| 电流 - 传输： | 30mA |
| 数据接口： | PCB，表面贴装 |
| 天线连接器： | PCB，表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-QFN |
| 包装： | 标准包装 |
| 产品目录页面： | 583 (CN2011-ZH PDF) |
| 其它名称： | 583-1095-6 |
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4.2 Interrupt Configuration Registers (IRQCFG)
0x0D - IRQCFG0D [default 0x00]
Name
Bits
R/W
Description
IRQ0 source in receive:
Continuous data mode -
00 → IRQ0 mapped to start pattern detect
01 → IRQ0 mapped to RSSI_IRQ
10,11 → IRQ0 mapped to start pattern detect
Buffered data mode -
00 → IRQ0 set to 0
RX_IRQ0
7,6
r/w
01 → IRQ0 mapped to Write_byte
10 → IRQ0 mapped to nFIFOEMPY (also in Standby mode)
11 → IRQ0 mapped to start pattern detect
Packet data mode -
00 → IRQ0 mapped to Data_Rdy
01 → IRQ0 mapped to Write_byte
10 → IRQ0 mapped to nFIFOEMPY (also in Standby mode)
11 → IRQ0 mapped to Node Address Match if ADDRS_cmp is enabled
11 → IRQ0 mapped to Start Pattern Detect if ADDRS_cmp is not enabled
IRQ1 source in receive mode.
Continuous data mode -
00 → IRQ1 mapped to DCLK
01,10,11 → IRQ1 mapped to DCLK
Buffered data mode -
00 → IRQ1 set to 0
RX_IRQ1
5,4
r/w
01 → IRQ1 mapped to FIFOFULL
10 → IRQ1 mapped to RSSI_IRQ
11 → IRQ1 mapped to FIFO_Int_Rx (also in Standby mode)
Packet data mode -
00 → IRQ1 mapped to CRC_OK
01 → IRQ1 mapped to FIFOFULL (also in Standby mode)
10 → IRQ1 mapped to RSSI_IRQ
11 → IRQ1 mapped to FIFO_Int_Rx (also in Standby mode)
IRQ1 source in transmit mode:
Continuous data mode -
0 or 1 → IRQ1 mapped to DCLK
0 or 1 → IRQ0 is set to 0
Buffered and Packet data modes -
0 → IRQ1 mapped to FIFOFULL
TX_IRQ1
3
r/w
1 → IRQ1 is mapped to TX_STOP
Note: IRQ0 mapped as follows for transmit mode:
Buffered data mode -
IRQ0 mapped to nFIFOEMPY
Packet data mode -
IRQ0 mapped to FIFO_Int_Tx if Start_Full = 0
IRQ0 mapped to nFIFOEMPY if Start_Full = 1
FIFOFULL
nFIFOEMPY
FIFO_OVR
2
1
0
r
r
r/w/c
FIFO full (IRQ source)
low when FIFO empty (IRQ source)
FIFO overrun error. Write a 1 to this bit to reset it and clear the FIFO.
Table 26
www.RFM.com E-mail: info@rfm.com
? 2009-2010 by RF Monolithics, Inc.
Technical support +1.800.704.6079
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TRC103 - 11/29/12
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