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参数资料
| 型号： | UPD703111GM-15-UEU |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 150 MHz, RISC MICROCONTROLLER, PQFP176 |
| 封装： | 24 X 24 MM, FINE PITCH, PLASTIC, LQFP-176 |
| 文件页数： | 123/238页 |
| 文件大小： | 6598K |
| 代理商： | UPD703111GM-15-UEU |
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CHAPTER 5 MEMORY ACCESS CONTROL FUNCTION
209
Preliminary User’s Manual U16031EJ2V1UD
5.3.4 SDRAM configuration registers 1, 3, 4, 6 (SCR1, SCR3, SCR4, SCR6)
These registers specify the number of waits and the address multiplex width. SCRn corresponds to CSn (n = 1, 3,
4, 6). For example, to connect SDRAM to CS1, set SCR1. These registers can be read or written in 16-bit units.
Cautions 1. An SDRAM read/write cycle is not generated prior to executing a register write operation.
Access SDRAM after reading the value of the SCRn register and confirming that the WCFn
bit is set to 1.
2. To write to the SCRn register again following access to SDRAM, clear the MEn bit of the
BCT0 and BCT1 registers to 0, and then set it to 1 again before performing access (n = 0 to
6).
3. Do not execute continuous instructions to write to the SCRn register. Be sure to insert
another instruction between commands to write to the SCRn register.
4. Start accessing SDRAM after all the SCRn registers have been set.
(1/3)
14
LTM12
13
LTM11
12
LTM10
2
RAW10
3
RAW11
4
SSO10
5
SSO11
6
BCW10
7
BCW11
8
WCF1
9
0
10
0
11
0
15
0
1
SAW11
0
SAW10
LTM32 LTM31 LTM30
RAW30
RAW31
SSO30
SSO31
BCW30
BCW31
WCF3
0
SAW31 SAW30
LTM42 LTM41 LTM40
RAW40
RAW41
SSO40
SSO41
BCW40
BCW41
WCF4
0
SAW41 SAW40
LTM62 LTM61 LTM60
RAW60
RAW61
SSO60
SSO61
BCW60
BCW61
WCF6
0
SAW61 SAW60
SCR1
SCR3
SCR4
SCR6
Address
FFFFF4A4H
FFFFF4ACH
FFFFF4B0H
FFFFF4B8H
After reset
30C0H
Bit position
Bit name
Function
Sets the CAS latency value for reading.
LTMn2
LTMn1
LTMn0
Latency
0
1
1 (setting prohibited during DMA flyby transfer)
01
0
2
01
1
3
Other than above
Setting prohibited
14 to 12
LTMn2 to
LTMn0
8
WCFn
Indicates that execution of a register write command on SDRAM has been completed
after the SCRn register was set. This bit is set to 1 when a register write command is
generated. This bit can only be read.
0: Setting not completed
1. Setting completed
Remark
n = 1, 3, 4, 6
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PDF描述 |
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参数描述 |
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