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参数资料
| 型号： | UPD703111GM-15-UEU |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 150 MHz, RISC MICROCONTROLLER, PQFP176 |
| 封装： | 24 X 24 MM, FINE PITCH, PLASTIC, LQFP-176 |
| 文件页数： | 138/238页 |
| 文件大小： | 6598K |
| 代理商： | UPD703111GM-15-UEU |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页当前第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页第235页第236页第237页第238页
CHAPTER 5 MEMORY ACCESS CONTROL FUNCTION
222
Preliminary User’s Manual U16031EJ2V1UD
Figure 5-10. SDRAM Single Write Cycle (3/6)
(b) Page change (2/2)
Access by CPU
Write to address (A)
Write to address (B)
TWR
TACT
T0
Note 1
TACT
TWR
TPREC
T0
Note 1
BUSCLK (output)
A2 to A11 (output)
CSn (output)
SDRAS (output)
BCYST (output)
WE (output)
SDCAS (output)
A12 (output)
Bank address (output)
Note 2 (output)
Address
Row
Col.(A)
WR
ACT(Bnk.A)
Address
ACT(Bnk.A)
PRE(Bnk.A)
Address
WR
Bnk.A
Row
Col.(B)
Bnk.A
Address
Page change
D0 to D31 (I/O)
Note 4 (output)
Data
Command
Note 3 (output)
Notes 1.
State (T0) inserted between bus cycles
2.
Addresses other than the bank address, A12, and A2 to A11.
3.
When xxWR output mode/xxDQM output mode is set (PFCCTm bit of PFCCT register = 0)
4.
When xxBE output mode/xxDQM output mode is set (PFCCTm bit of PFCCT register = 1)
Remarks 1. The broken lines indicate the high-impedance state.
2. n = 1, 3, 4, 6
m = 0 to 3
xx = UU, UL, LU, LL
3. Bnk.: Bank address
Col.: Column address
Row: Row address
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PDF描述 |
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参数描述 |
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