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参数资料
| 型号： | UPD703111GM-15-UEU |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 150 MHz, RISC MICROCONTROLLER, PQFP176 |
| 封装： | 24 X 24 MM, FINE PITCH, PLASTIC, LQFP-176 |
| 文件页数： | 217/238页 |
| 文件大小： | 6598K |
| 代理商： | UPD703111GM-15-UEU |
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8
Preliminary User’s Manual U16031EJ2V1UD
Major Revisions in This Edition (3/4)
Page
Description
p.475
Addition of 9.3.7 (6) Overflow interrupt signal (INTOV1n) and underflow interrupt signal (INTUD1n)
p.477
Modification of transfer rate in 10.2.1 Features
p.479
Modification of description in 10.2.2 (10) UARTBn receive data register AP (UBnRXAP), UARTBn
receive data register (UBnRX) (n = 0, 1)
p.480
Addition of description in 10.2.2 (12) UARTBn transmit data register n (UBnTX) (n = 0, 1)
p.487
Modification of Caution in 10.2.3 (3) UARTBn control register 2 (UBnCTL2) (n = 0, 1)
p.488
Addition of description in 10.2.3 (4) UARTBn transmit data register (UBnTX) (n = 0, 1)
p.489
Modification of description in 10.2.3 (5) UARTBn receive data register AP (UBnRXAP), UARTBn receive
data register (UBnRX) (n = 0, 1)
pp.491, 492
Addition and modification of description in 10.2.3 (6) UARTBn FIFO control register 0 (UBnFIC0) (n = 0, 1)
p.493
Modification of description in 10.2.3 (7) UARTBn FIFO control register 1 (UBnFIC1) (n = 0, 1)
p.501
Addition of description in 10.2.4 (5) (b) FIFO mode
p.503
Addition of description in 10.2.5 (2) Pending mode/pointer mode
p.503
Addition of Note in 10.2.5 (2) (a) (i) During transmission (writing to transmit FIFOn)
p.504
Addition of Note in 10.2.5 (2) (a) (ii) During reception (reading from receive FIFOn)
p.512
Addition of description in 10.2.6 (4) (c) (ii) Reception timeout interrupt (UBTITOn) (in FIFO mode only)
p.518
Addition of value when fX = 150 MHz in Table 10-4 Baud Rate Generator Setting Data
p.522
Addition of 10.2.8 Control flow
p.535
Modification of description in Figure 10-22 Block Diagram of Clocked Serial Interfaces 30 and 31
p.536
Modification of description of Caution 2 in 10.3.3 (1) Clocked serial interface mode registers 30, 31
(CSIM30, CSIM31)
p.540
Modification of description in 10.3.3 (2) Clocked serial interface clock select registers 30, 31 (CSIC30,
CSIC31)
p.541
Addition of description in 10.3.3 (3) Receive data buffer registers 30, 31 (SIRB30, SIRB31)
p.542
Addition of description in 10.3.3 (4) Transmit data CSI buffer registers 30, 31 (SFDB30, SFDB31)
p.544
Modification of description in 10.3.3 (5) CSIBUF status registers 30, 31 (SFA30, SFA31)
p.549
Modification of example in Caution 2 in 10.3.4 (2) Baud rate
p.553
Modification of description in Figure 10-25 Transfer Data Length: 8 Bits (CCLn3 to CCLn0 Bits = 1000 in
CSIL3n Register), Transfer Direction: MSB First (DIRn Bit = 0 in CSIM3n Register)
p.555
Modification of description in Figure 10-26 Transfer Data Length: 8 Bits (CCLn3 to CCLn0 Bits = 1000
in CSIL3n Register), Transfer Direction: LSB First (DIRn Bit = 1 in CSIM3n Register)
p.559
Deletion of description of 10.3.5 (7) Slave mode
p.559
Modification of Figure 10-30 Slave Mode (CKPn and DAPn Bits = 00 in CSIC3n Register, CCLn3 to
CCLn0 Bits = 1000 in CSIL3n Register (Transfer Data Length: 8 Bits))
p.563
Modification of description in Figure 10-32 Continuous Mode
p.564
Modification of description in 10.3.5 (11) Transmission mode
p.564
Addition of description in 10.3.5 (12) Reception mode
p.567
Deletion of description in 10.3.5 (16) (a) SCKn pin
p.567
Modification of description in Table 10-8 Default Output Level of SCKn Pin
pp.568 to 573
Modification of description of (1) to (12) in 10.3.6 Usage
p.575
Addition of Caution in 11.1 Overview
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PDF描述 |
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