参数资料
型号: DSP56301VF100
厂商: Freescale Semiconductor
文件页数: 67/124页
文件大小: 0K
描述: IC DSP 24BIT FIXED-POINT 252-BGA
产品变化通告: DSP56301 Discontinuation 12/Nov/2009
标准包装: 60
系列: DSP563xx
类型: 定点
接口: 主机接口,SSI,SCI
时钟速率: 100MHz
非易失内存: ROM(9 kB)
芯片上RAM: 24kB
电压 - 输入/输出: 3.30V
电压 - 核心: 3.30V
工作温度: -40°C ~ 100°C
安装类型: 表面贴装
封装/外壳: 252-BGA
供应商设备封装: 252-MAPBGA(21x21)
包装: 托盘
AC Electrical Characteristics
DSP56301 Technical Data, Rev. 10
Freescale Semiconductor
2-21
Figure 2-17.
DRAM Out-of-Page Wait States Selection Guide
Table 2-12.
DRAM Out-of-Page and Refresh Timings, Eight Wait States1, 2
No.
Characteristics3
Symbol
Expression
80 MHz
Unit
Min
Max
157
Random read or write cycle time
tRC
9
× TC
112.5
ns
158
RAS assertion to data valid (read)
tRAC
4.75
× TC 6.5
52.9
ns
159
CAS assertion to data valid (read)
tCAC
2.25
× TC 6.5
21.6
ns
160
Column address valid to data valid (read)
tAA
3
× TC 6.5
31.0
ns
161
CAS deassertion to data not valid (read hold time)
tOFF
0.0
ns
162
RAS deassertion to RAS assertion
tRP
3.25
× TC 4.0
36.6
ns
163
RAS assertion pulse width
tRAS
5.75
× TC 4.0
67.9
ns
164
CAS assertion to RAS deassertion
tRSH
3.25
× TC 4.0
36.6
ns
165
RAS assertion to CAS deassertion
tCSH
4.75
× TC 4.0
55.4
ns
166
CAS assertion pulse width
tCAS
2.25
× TC 4.0
24.1
ns
167
RAS assertion to CAS assertion
tRCD
2.5
× TC ± 2
29.3
33.3
ns
168
RAS assertion to column address valid
tRAD
1.75
× TC ± 2
19.9
23.9
ns
169
CAS deassertion to RAS assertion
tCRP
4.25
× TC 4.0
49.1
ns
170
CAS deassertion pulse width
tCP
2.75
× TC 6.0
28.4
ns
171
Row address valid to RAS assertion
tASR
3.25
× TC 4.0
36.6
ns
Chip Frequency
(MHz)
DRAM Type
(tRAC ns)
100
80
70
50
66
80
100
4 Wait States
8 Wait States
11 Wait States
15 Wait States
Note:
This figure should be used for primary selection. For
exact and detailed timings, see the following tables.
60
40
120
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