参数资料
| 型号： | KIT13892VLEVBEJ |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 43/158页 |
| 文件大小： | 0K |
| 描述： | KIT EVAL FOR MC13892 |
| 标准包装： | 1 |
| 主要目的： | 电源管理和用户界面 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | MC13892 |
| 主要属性： | 10 位 ADC，4 输出降压转换器，12 LDO |
| 次要属性： | 与 i.MX51、i.MX37、i.MX35、i.MX27 一起使用 |
| 已供物品： | 板，线缆，文档 |
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FUNCTIONAL DEVICE OPERATION
PROGRAMMABILITY
Table 10. SPI Interface Timing Specifications
Parameter
t SELSU
t SELHLD
t SELLOW
t CLKPER
t CLKHIGH
t CLKLOW
t WRTSU
t WRTHLD
t RDSU
t RDHLD
t RDEN
t RDDIS
Description
Time CS has to be high before the first rising edge of CLK
Time CS has to remain high after the last falling edge of CLK
Time CS has to remain low between two transfers
Clock period of CLK
Part of the clock period where CLK has to remain high
Part of the clock period where CLK has to remain low
Time MOSI has to be stable before the next rising edge of CLK
Time MOSI has to remain stable after the rising edge of CLK
Time MISO will be stable before the next rising edge of CLK
Time MISO will remain stable after the falling edge of CLK
Time MISO needs to become active after the rising edge of CS
Time MISO needs to become inactive after the falling edge of CS
t min (ns)
15
15
15
38
15
15
4.0
4.0
4.0
4.0
4.0
4.0
Notes
46. This table reflects a maximum SPI clock frequency of 26 MHz
Table 11. SPI Interface Logic IO Specifications
Parameter
Input Low CS, MOSI, CLK
Input High CS, MOSI, CLK
Output Low MISO, INT
Output High MISO, INT
SPIVCC Operating Range
Condition
Output sink 100 μ A
Output source 100 μ A
Min
0.0
0.7*SPIVCC
0
SPIVCC-0.2
1.75
Typ
–
–
–
–
–
Max
0.3*SPIVCC
SPIVCC+0.3
0.2
SPIVCC
3.1
Units
V
V
V
V
V
CL = 50 pF, SPIVCC = 1.8 V
SPIDRV[1:0] = 00 (default)
–
11
–
ns
MISO Rise and Fall Time
SPIDRV[1:0] = 01
SPIDRV[1:0] = 10
SPIDRV[1:0] = 11
–
–
–
6.0
High Z
22
–
–
–
ns
ns
ns
MC13892
Analog Integrated Circuit Device Data
Freescale Semiconductor
43
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