参数资料
| 型号： | KIT13892VLEVBEJ |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 47/158页 |
| 文件大小： | 0K |
| 描述： | KIT EVAL FOR MC13892 |
| 标准包装： | 1 |
| 主要目的： | 电源管理和用户界面 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | MC13892 |
| 主要属性： | 10 位 ADC，4 输出降压转换器，12 LDO |
| 次要属性： | 与 i.MX51、i.MX37、i.MX35、i.MX27 一起使用 |
| 已供物品： | 板，线缆，文档 |
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FUNCTIONAL DEVICE OPERATION
I2C INTERFACE
Table 12. Interrupt, Mask and Sense Bits
Interrupt
Mask
Sense
Purpose
Trigger
DebounceTi
me
Section
Low battery warning
LOBATHI
LOBATHM
LOBATHS
Sense is 1 if above LOBATH
Dual
30 μ s
threshold.
L2H: 20-
VBUSVALIDI
VBUSVALIDM
VBUSVALIDS
Detects A-Session Valid on VBUS
Dual
24 ms
H2L: 8-
12 ms
IDFLOATI
IDGNDI
IDFACTORYI
CHRGSE1BI
SCPI
BATTDETBI
1HZI
TODAI
PWRON1I
PWRON2I
PWRON3I
SYSRSTI
WDIRESETI
PCI
WARMI
MEMHLDI
CLKI
RTCRSTI
THWARNHI
THWARNLI
LPBI
IDFLOATM
IDGNDM
IDFACTORYM
CHRGSE1BM
SCPS
BATTDETBM
1HZM
TODAM
PWRON1M
PWRON2M
PWRON3M
SYSRSTM
WDIRESETM
PCM
WARMM
MEMHLDM
CLKM
RTCRSTM
THWARNHM
THWARNLM
LPBM
IDFLOATS
IDGNDS
IDFACTORYS
CHRSE1BS
–
BATTDETBS
–
–
PWRON1S
PWRON2S
PWRON3S
–
–
–
–
–
CLKS
–
THWARNHS
THWARNLS
LPBS
ID floating detect. Sense is 1 if
above threshold
USB ID ground detect. Sense is 1
if not to ground
ID voltage for Factory mode detect
Sense is 1 if above threshold
Wall charger detect
Regulator short-circuit protection
tripped
Short circuit protection trip
detection
Battery removal detect
1.0 Hz time tick
Time of day alarm
PWRON1 event
Sense is 1 if pin is high.
PWRON2 event
Sense is 1 if pin is high.
PWRON3 event
Sense is 1 if pin is high.
System reset through PWRONx
pins
WDI silent system restart
Power cut event
Warm Start event
Memory Hold event
Clock source change
Sense is 1 if source is XTAL
RTC reset or intrusion has
occurred
Thermal warning higher threshold
Sense is 1 if above threshold
Thermal warning lower threshold
Sense is 1 if above threshold
Low-power boot interrupt
Dual
Dual
Dual
Dual
L2H
L2H
Dual
L2H
L2H
H2L
L2H
H2L
L2H
H2L
L2H
L2H
L2H
L2H
L2H
L2H
Dual
L2H
Dual
Dual
Dual
90 μ s
90 μ s
90 μ s
1.0 ms
200 μ s
0
30 ms
0
0
30 ms (1)
30 ms
30 ms (47)
30 ms
30 ms (47)
30 ms
0
0
0
0
0
0
0
30 ms
30 ms
1.0 ms
Notes
47. Debounce timing for the falling edge can be extended with PWRONxDBNC[1:0]; refer to Power Control System for details.
Additional sense bits are available to reflect the state of the power up mode selection pins, as summarized in Table 13 .
MC13892
Analog Integrated Circuit Device Data
Freescale Semiconductor
47
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