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参数资料
| 型号： | M37274MA-XXXSP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, MICROCONTROLLER, PDIP52 |
| 封装： | 0.600 INCH, 1.778 MM PITCH, SHRINK, PLASTIC, DIP-52 |
| 文件页数： | 32/131页 |
| 文件大小： | 2049K |
| 代理商： | M37274MA-XXXSP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页当前第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页
127
MITSUBISHI MICROCOMPUTERS
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER with CLOSED CAPTION DECODER
and ON-SCREEN DISPLAY CONTROLLER
M37274MA-XXXSP
PRELIMINARY
Notice:
This
is not
a final
specification.
Some
paramentic
limits
are
subject
to change.
Window H Register 2
Window H Register 1
Address 021C16
Address 021E16
Window L Register 1
Address 021D16
b7 b6 b5 b4 b3 b2 b1 b0
Window H register 1 (WH1) [Address 021C 16]
B
Name
Functions
After reset
R W
Window H Register 1
0
to
7
Control bits of window
top boundary
(WN10 to WN17)
(See note 1)
Top boundary position (low-order 8 bits)
TH !
(setting value of low-order 2 bits of WH2 ! 162
+ setting value of high-order 4 bits of WH1 ! 161
+ setting value of low-order 4 bits of WH1 ! 160)
Indeterminate RW
Notes 1: Set values except “00 16” to the WH1 when WH2 is “00 16.”
2: TH is cycle of HSYNC.
b7 b6 b5 b4 b3 b2 b1 b0
Window L register 1 (WL1) [Address 021D 16]
B
Name
Functions
After reset
R W
Window L Register 1
0
to
7
Control bits of window
top boundary
(WL10 to WL17)
(See note 1)
Top boundary position (low-order 8 bits)
TH !
(setting value of low-order 2 bits of WL2 ! 162
+ setting value of high-order 4 bits of WL1 ! 161
+ setting value of low-order 4 bits of WL1 ! 160)
Indeterminate RW
Notes 1: Set values fit for the following condition: (WH1+WH2)<(WL1+WL2)
2: TH is cycle of HSYNC.
b7 b6 b5 b4 b3 b2 b1 b0
Window H register 2 (WH2) [Address 021E 16]
B
Name
Functions
After reset
R W
Window H Register 2
0, 1 Control bits of window
top boundary
(WN20 to WN27)
(See note 1)
Top boundary position (high-order 2 bits)
TH !
(setting value of low-order 2 bits of WH2 ! 162
+ setting value of high-order 4 bits of WH1 ! 161
+ setting value of low-order 4 bits of WH1 ! 160)
Indeterminate RW
Notes 1: Set values except “00 16” to the WH1 when WH2 is “00 16.”
2: TH is cycle of HSYNC.
Nothing is assigned. These bits are write disable bits.
When these bits are read out, the values are indeterminate.
2
to
7
Indeterminate R—
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