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参数资料
| 型号： | PM8621-BIAP |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480 |
| 封装： | 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480 |
| 文件页数： | 113/184页 |
| 文件大小： | 1122K |
| 代理商： | PM8621-BIAP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页当前第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
112
Register 111h + N*20H, ILC Transmit Control Register
Bit
Type
Function
Default
Bit 31:16
Unused
X
Bit 15:8
R/W
TX_AUX[7:0]
00000000
Bit 7:6
R
Reserved
00
Bit 5:4
R/W
TX_LINK[1:0]
00
Bit 3:2
R
Reserved
00
Bit 1
R/W
TX_CRC_SWIZ_EN
0
Bit 0
R/W
TX_BYPASS
0
TX_BYPASS
When this bit is set to ‘1’, the blocks message transmit functions are bypassed. No messages
are inserted into the Transmit Bus data The respective signals are passed through the block’s
pipeline unmodified. Transmit message FIFO RAM is disabled and thus message data writes
are ignored.
TX_CRC_SWIZ_EN
When this bit is set to ‘1’, the calculated CRC-16 is bit reversed before being transmitted.
This facility can be used for diagnostic testing of CRC-16 generation and checking
functionality.
TX_LINK[1:0]
These bits are transmitted in the LINK bits of the message header of the next available
message. On reads these bit return the last written value.
TX_AUX[7:0]
These bits form the input to an Auxiliary channel between CPUs at each end of the link. Their
use is at the Software developers’ discretion. Data written to this register will be transmitted
in the AUX header byte of each subsequent message to the other end of the inband link. A
new value of TX_AUX will be transmitted at the next available message.
Data read from this register will be the data previously written.
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|---|---|
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