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参数资料
| 型号： | PM8621-BIAP |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480 |
| 封装： | 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480 |
| 文件页数： | 123/184页 |
| 文件大小： | 1122K |
| 代理商： | PM8621-BIAP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页当前第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
122
RX_TIMEOUTE
Writing a ‘1’ to the RX_TIMEOUTE bit enables the generation of an interrupt when
RX_TIMEOUTI is a ‘1’
RX_THRSHLD_VAL[2:0]
Variable Threshold dictates the minimum number of messages required to be in the RXFIFO
before an interrupt is generated. ‘000’ = 1 message ‘111’ = 8 messages.
Table 9 RXFIFO Threshold Values
RX_THRSHLD_VAL [2:0]
Messages
000
1
001
2
010
3
011
4
100
5
101
6
110
7
111
8
If the RXFIFO has not been read for the amount of time indicated by the
RXFIFO_Timeout_delay AND the FIFO is not empty an interrupt will be generated if this bit
is ‘1’. To disable set to ‘0’.
If the RXFIFO overflows an interrupt will be generated if this bit is ‘1’. To disable set to ‘0’.
If the Rx Message fails its CRC check, an interrupt will be generated if this bit is ‘1’. To
disable set to ‘0’.
RX_TIMEOUT_VAL
These bits specify a variable delay, relative to a read from the receive message FIFO, in steps
of 125 us, before an interrupt is generated, if the Receive FIFO level is greater than 0. The
objective is to stop stale messages collecting in the RXFIFO.
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PDF描述 |
|---|---|
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| PM871 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Analog IC |
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