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参数资料
| 型号： | PM8621-BIAP |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480 |
| 封装： | 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480 |
| 文件页数： | 138/184页 |
| 文件大小： | 1122K |
| 代理商： | PM8621-BIAP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页当前第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
137
Figure 18 “C1” Synchronization Control
Ingress SBI
device
Ingress SBS
(1 frame delay)
Egress SBS
(1 frame delay)
500
μ
s Source
delay
t
1
t
0
,
t
1
t
2
t
3
t
4
delay
125
μ
s
t at 0
μ
s
Egress SBI
device
delay
t
2
delay
t
3
delay
t
4
t
0
NSE
delay
125
μ
s
(no delay t delay through
Ingress SBI device)
12.3
Synchronized Control Setting Changes
The NSE-8G and SBS support dual switch control settings. These dual settings permit one bank
of settings to be operational while the other bank is updated as a result of some new connection
requests. The CMP input selects the current operational switch control settings. CMP is sampled
by the NSE-8G on the RC1FP
.
The internal blocks sample the registered CMP value as they
receive the next C1 character after a delay of RC1DLY. The new CMP value is applied on the first
A1 character of the following STS-12 frame. This switchover is hitless; the control change does
not disrupt the user data flow in any way. This feature is required for the addition of arbitrary new
connections, as existing connections may need to be rerouted (see the discussion of the
connection routing algorithm in this document).
The DS0-granularity switch settings RAM in organized into two control settings banks, these are
switched by the above mechanisms on C1 boundaries. The NSE-8G also has to coordinate the
switching of the connected SBS devices (if using the In-Band link facility), so a broader
understanding of the issues is required.
The following sections provide examples.
12.3.1 SBS/NSE-8G Systems with DS0 and CAS Switching
When building a DS0 and Channel Associated Signaling switching system with the SBS, SBS-lite
and NSE-8G devices the overall timing is based on the CAS signaling multiframe on the SBI bus.
In this configuration the delay through the SBS devices is a single 125 μS SBI frame plus a few
77.76 MHz clocks and the delay through the NSE-8G is a few 77.76 MHz clocks. A single C1FP
frame synchronization signal is distributed around the system. Internal to the SBS and NSE-8G
devices are programmable offsets used to account for propagation delays through the system. The
key constraint is that all SBI frames are aligned going into the NSE-8G device.
Compatible devices are TEMUX-84, FREEDM-336, FREEDM-336-84 bond-out, S/UNI-IMA-
84, and other future SBI336 devices.
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PDF描述 |
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| PM871 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Analog IC |
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