参数资料
型号: PM8621-BIAP
厂商: PMC-SIERRA INC
元件分类: 数字传输电路
英文描述: NSE-8G⑩ Standard Product Data Sheet Preliminary
中文描述: ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480
封装: 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480
文件页数: 125/184页
文件大小: 1122K
代理商: PM8621-BIAP
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NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
124
Register 117h + N*20H: ILC Interrupt Reason Register
Bit
Type
Function
Default
Bit 31:0
Unused
X
Bit 15:7
R
Reserved
000000000
Bit 6
R
RX_TIMEOUTI
0
Bit 5
R
RX_THRSHLDI
0
Bit 4
R
RX_OVFLWI
0
Bit 3
R
RX_LINK_CHGI
0
Bit 2:1
R
RX_PAGE_CHGI[1:0]
0
Bit 0
R
RX_OUSER0_CHGI
0
This register contains the status of events that may be enabled to generate interrupts.
All bits in this register are cleared on read
RX_OUSER0_CHGI
A ‘1’ in this bit indicates that the last received value of the RX_USER[0] header bit has
changed from a ‘0’ to a ‘1’ from the previously received values. This bit is cleared on a read.
RX_PAGE_CHGI [1:0]
A ‘1’ in these bits indicates that the last received value of the corresponding RX_PAGE[1:0]
header bits has changed from the previously received values. These bits are cleared on read.
RX_LINK_CHGI
A ‘1’ in this bit indicates that the last received value of the LINK[1:0] header bits has
changed from the previously received values. This bit is cleared on a read.
RX_OVFLWI
This bit, when ‘1’, indicates a Receive FIFO Overflow. This bit is cleared on a read.
RX_THRSHLDI
This bit, when ‘1’, indicates a Receive FIFO Threshold reached. This bit is cleared on a read.
RX_TIMEOUTI
This bit, when ‘1’, indicates a Receive FIFO Timeout. This bit is cleared on read.
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