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参数资料
| 型号： | PM8621-BIAP |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | NSE-8G⑩ Standard Product Data Sheet Preliminary |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA480 |
| 封装： | 35 X 35 MM, 1.47 MM HEIGHT, UBGA-480 |
| 文件页数： | 97/184页 |
| 文件大小： | 1122K |
| 代理商： | PM8621-BIAP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页当前第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
NSE-8G Standard Product Data Sheet
Preliminary
Proprietary and Confidential to PMC-Sierra, Inc., and for its Customers’ Internal Use
Document ID: PMC-2010850, Issue 1
96
Register 04DH: DCB Interrupt status Register.
Bit
Type
Function
Default
Bit 31-3
X
Unused
0
Bit 2
I
SWAPI
X
Bit 1
I
UPDATEI
X
Bit 0
I
FRAMEI
X
Writing to this register initiates copying of the active connection memory page to the offline
connection memory page. When a page swap is pending (SWAPV =’1’) writing to this register
may cause a corruption of the connection memory pages.
SWAPI
This bit reports and acknowledges a change of state in the SWAPV bit of the Configuration
register. This bit is cleared when this register is read. When enabled by SWAPE, the INT
output reflects the state of this bit.
UPDATEI
The offline page copy interrupt status bit, UPDATEI reports and acknowledges a change of
state from 1 to 0 in the UPDATEV bit of the Configuration register. This signifies that a page
copy is complete. This bit is cleared when read. When enabled by the UPDATEE bit, the INT
output reflects the state of this bit.
FRAMEI
The frame interrupt status bit reports the sampling of the CMP bit at the expected RC1FP
position. When enabled by FRAMEE, frequency of occurrence of FRAMEI is dependent on
MF_SWAP. When enabled by the FRAMEE bit, the INT output reflects the state of this bit.
MF_SWAP FRAMEI occurs every
00
1 frame
01
4 frame
10
4 frame
11
48 frame
This bit is cleared when read.
A change in the CMP input should be sequenced to occur as soon as possible after the
occurrence of FRAMEI. Changing CMP prior to the occurrence of FRAMEI may cause
unpredictable behavior as it may cause CMP to be sampled later than expected.
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